Questões de Concurso
Sobre flip-flops em engenharia eletrônica
Foram encontradas 118 questões
Q65925
Engenharia Eletrônica
Texto associado
Um sistema digital pode ser definido como um conjunto
de componentes conectados para processar informação em forma
digital. Os componentes básicos utilizados na construção de
sistemas digitais são dispositivos eletrônicos que vão de circuitos
biestáveis a computadores completos. As ligações entre esses
componentes eletrônicos são conexões físicas, por meio das quais
a informação digital pode ser transmitida. O número de
elementos pode chegar a milhares de componentes. Quanto mais
componentes são necessários para a realização de um sistema
digital, mais complexo ele é e mais difícil se torna entender seu
funcionamento ou projetá-lo.
A partir do texto acima, julgue os itens subsequentes.
de componentes conectados para processar informação em forma
digital. Os componentes básicos utilizados na construção de
sistemas digitais são dispositivos eletrônicos que vão de circuitos
biestáveis a computadores completos. As ligações entre esses
componentes eletrônicos são conexões físicas, por meio das quais
a informação digital pode ser transmitida. O número de
elementos pode chegar a milhares de componentes. Quanto mais
componentes são necessários para a realização de um sistema
digital, mais complexo ele é e mais difícil se torna entender seu
funcionamento ou projetá-lo.
A partir do texto acima, julgue os itens subsequentes.
Contadores são dispositivos de múltiplas e importantes aplicações e são classificados em dois tipos: assíncronos e síncronos. Todos os contadores são realizados com um conjunto de flip-flops em série. O contador síncrono é um circuito combinatório no qual todos os flip-flops estão sob controle de um mesmo pulso de clock, enquanto que no contador assíncrono isso não ocorre.
Ano: 2009
Banca:
CESPE / CEBRASPE
Órgão:
DETRAN-DF
Prova:
CESPE - 2009 - DETRAN-DF - Analista - Engenharia Elétrica |
Q73578
Engenharia Eletrônica
Texto associado
A figura acima representa um flip-flop RS básico, construído a
partir de portas NÃO-E (NE) e inversores. No circuito, as
variáveis de entrada são S e R e Q representa a saída anterior
à aplicação das entradas.
Considerando essas informações, julgue os itens que se seguem.
A figura acima representa um flip-flop RS básico, construído a
partir de portas NÃO-E (NE) e inversores. No circuito, as
variáveis de entrada são S e R e Q representa a saída anterior
à aplicação das entradas.
Considerando essas informações, julgue os itens que se seguem.
A situação quando S = 1 e R = 1 não poderá ser permitida na entrada, porque forçaria o flip-flop a assumir um estado de saída no qual Q teria que ser igual à saída complementar 
Ano: 2009
Banca:
CESPE / CEBRASPE
Órgão:
DETRAN-DF
Prova:
CESPE - 2009 - DETRAN-DF - Analista - Engenharia Elétrica |
Q73577
Engenharia Eletrônica
Texto associado
A figura acima representa um flip-flop RS básico, construído a
partir de portas NÃO-E (NE) e inversores. No circuito, as
variáveis de entrada são S e R e Q representa a saída anterior
à aplicação das entradas.
Considerando essas informações, julgue os itens que se seguem.
A figura acima representa um flip-flop RS básico, construído a
partir de portas NÃO-E (NE) e inversores. No circuito, as
variáveis de entrada são S e R e Q representa a saída anterior
à aplicação das entradas.
Considerando essas informações, julgue os itens que se seguem.
A saída que o flip-flop irá assumir (após a aplicação das entradas) depende somente das entradas S e R.
Ano: 2009
Banca:
CESPE / CEBRASPE
Órgão:
TRT - 17ª Região (ES)
Prova:
CESPE - 2009 - TRT - 17ª Região (ES) - Analista Judiciário - Engenharia Elétrica |
Q19543
Engenharia Eletrônica
Texto associado
Considerando a figura acima, que mostra o diagrama lógico de
uma célula de memória RAM construída a partir de flip-flop,
julgue os itens subsequentes.
Considerando a figura acima, que mostra o diagrama lógico de
uma célula de memória RAM construída a partir de flip-flop,
julgue os itens subsequentes.
Caso a alimentação do circuito ilustrado pelo diagrama seja desligada, o flip-flop passará a um estado imprevisível, perdendo o estado atual.
Ano: 2009
Banca:
CESPE / CEBRASPE
Órgão:
TRT - 17ª Região (ES)
Prova:
CESPE - 2009 - TRT - 17ª Região (ES) - Analista Judiciário - Engenharia Elétrica |
Q19542
Engenharia Eletrônica
Texto associado
Considerando a figura acima, que mostra o diagrama lógico de
uma célula de memória RAM construída a partir de flip-flop,
julgue os itens subsequentes.
Considerando a figura acima, que mostra o diagrama lógico de
uma célula de memória RAM construída a partir de flip-flop,
julgue os itens subsequentes.
Esse diagrama lógico refere-se a uma célula de memória RAM estática de 4 bits.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161876
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Os controles PR e CLR dependem da entrada clock para atuarem.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161875
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Os controles de PR e clear (CLR) estão simultaneamente ligados aos circuitos mestre e escravo.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
SEPLAG-DF
Prova:
CESPE - 2008 - SEPLAG-DF - Professor - Eletrônica |
Q161874
Engenharia Eletrônica
Texto associado
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
A figura acima mostra um Flip-Flop do tipo JK mestre-escravo
com entrada preset (PR) e clear (CLR). Considerando essas
informações, julgue os itens seguintes.
Suponha que o controle de preset (PR) assuma o valor zero. Então, para esta condição, a saída Q do circuito também assumirá o valor zero.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153896
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Se as saídas do encoder incremental se comportarem como ilustrado no caso B, então a saída 
do Flip-flop do tipo D sempre estará em nível lógico baixo.
do Flip-flop do tipo D sempre estará em nível lógico baixo.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153895
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Como a entrada CLR do flip-flop do tipo D é ativada por nível alto, e essa entrada está em nível baixo, então a saída 
sempre estará em nível alto.
sempre estará em nível alto.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153894
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Se as saídas do encoder incremental se comportarem conforme ilustrado no caso A, então a saída 
do flip-flop do tipo D sempre estará em nível lógico alto.
do flip-flop do tipo D sempre estará em nível lógico alto.
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153893
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Se o sinal 
estivesse sempre em nível alto, a porta ou-exclusivo (exclusive-Or) inverteria o sinal 
estivesse sempre em nível alto, a porta ou-exclusivo (exclusive-Or) inverteria o sinal
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153892
Engenharia Eletrônica
Texto associado
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
Um encoder incremental possui dois sinais de saída, na forma de onda
quadrada, de mesma freqüência e defasados em ¼ de ciclo. Assumindo que
as saídas dos canais tenham ciclo de trabalho de 50%, existem duas
possibilidades para a temporização dos mesmos, conforme indicado por caso
A e caso B na figura acima. Os sinais do encoder incremental são
processados pelo circuito digital indicado na mesma figura. Acerca do
funcionamento desse circuito em regime permanente, e considerando que
todos os componentes do circuito são ideais, julgue os itens subseqüentes.
O sinal 
possui freqüência duas vezes maior que a freqüência do sinal 
.
possui freqüência duas vezes maior que a freqüência do sinal .
Ano: 2008
Banca:
CESPE / CEBRASPE
Órgão:
HEMOBRÁS
Prova:
CESPE - 2008 - HEMOBRÁS - Especialista em Produção de Hemoderivados - Engenheiro Eletrônico |
Q153879
Engenharia Eletrônica
Texto associado
Considerando um sistema de comunicação digital que possua as
características mostradas na figura acima, referentes ao sinal digital e à
seqüência binária resultante, julgue os itens seguintes.
Considerando um sistema de comunicação digital que possua as
características mostradas na figura acima, referentes ao sinal digital e à
seqüência binária resultante, julgue os itens seguintes.
O sinal digital é codificado de modo que cada bit no estado 1 e no estado zero corresponde às tensões aproximadamente iguais a +10 V e -10 V, respectivamente.
Q2910247
Engenharia Eletrônica
Determine o número de flip- flops que seriam necessários
para se construir os contadores de módulos 6,11,15,19,e
31, respectivamente.
Q214749
Engenharia Eletrônica
Um tipo de saída, em lógica digital, conhecida como “coletor aberto” (open colector), é uma propriedade:
Q214745
Engenharia Eletrônica
São chamados de biestáveis por terem dois estados lógicos estáveis:
Ano: 2004
Banca:
CESPE / CEBRASPE
Órgão:
Polícia Federal
Prova:
CESPE / CEBRASPE - 2004 - Polícia Federal - Perito Criminal - Engenharia Elétrica - Eletrônica |
Q2042946
Engenharia Eletrônica
Com relação ao circuito seqüencial cujo diagrama está ilustrado acima, e considerando que os bits D, C, B e A formam um número variável binário em que D é o bit mais significativo, julgue os itens subseqüentes.
Trata-se de um contador assíncrono.
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