Questões de Engenharia Eletrônica - Álgebra Booleana e Circuitos Lógicos em Engenharia Eletrônica para Concurso - Página 12

Q907331

Ano: 2016 Banca: FGV Órgão: COMPESA Prova: FGV - 2016 - COMPESA - Assistente de Saneamento e Gestão - Técnico Operacional - Habilitação em Eletrônica |

Q907331 Engenharia Eletrônica

Um sinal de relógio de 100 MHz cadencia um circuito digital síncrono.

O maior atraso permitido para um circuito combinacional a esse sincronismo é de

A

1 ns.

B

5 ns.

C

10 ns.

D

50 ns.

E

100 ns.

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Q907321

Ano: 2016 Banca: FGV Órgão: COMPESA Prova: FGV - 2016 - COMPESA - Assistente de Saneamento e Gestão - Técnico Operacional - Habilitação em Eletrônica |

Q907321 Engenharia Eletrônica

A figura a seguir apresenta um circuito lógico digital.

Imagem associada para resolução da questão

Considerando as entradas A, B e C, a saída em S é:

A

B

C

D

E

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Q907319

Ano: 2016 Banca: FGV Órgão: COMPESA Prova: FGV - 2016 - COMPESA - Assistente de Saneamento e Gestão - Técnico Operacional - Habilitação em Eletrônica |

Q907319 Engenharia Eletrônica

A figura a seguir apresenta a tabela verdade de um circuito digital.

Imagem associada para resolução da questão

A saída desse circuito é

A

ab + bc

B

C

D

E

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Q757598

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUPEST-UFSC) |

Q757598 Engenharia Eletrônica

A montagem abaixo tem a finalidade descrita na alternativa:
Imagem associada para resolução da questão

A

Contador Síncrono

B

Comparador Assíncrono

C

Comparador Síncrono

D

Integrador Síncrono

E

Integrador Assíncrono

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Q757597

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUPEST-UFSC) |

Q757597 Engenharia Eletrônica

A função Y do circuito digital abaixo está corretamente descrita na alternativa:

Imagem associada para resolução da questão

A

(A’ + B) + (B’.C’.D) + (A’.C’.D’)

B

(A.B’) + (B’.C’.D’) + (A.C.D)

C

(A + B’) + (B.C.D’) + (A’.C’.D’)

D

(A’.B’) + (B.C’.D) + (A’ + C’ + D’)

E

(A.B’) + (B’.C.D) + (A’.C’.D’)

Q752177

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Clínico (HUAP-UFF) |

Q752177 Engenharia Eletrônica

O circuito digital apresentado na figura abaixo é um decodificador BCD para 7 segmentos. Como você sabe, essa função permite apresentar qualquer número decimal que foi codificado em sistema binário. Dessa forma, em um monitor multiparamétrico, se um número binário 0111 foi apresentado nas entradas do circuito abaixo, teremos como resposta em um display o número:
Imagem associada para resolução da questão

A

5

B

7

C

8

D

11

E

111

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Q752174

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUAP-UFF) |

Q752174 Engenharia Eletrônica

Avalie a montagem a seguir e atribua respectivamente V (verdadeiro) ou F (falso) às afirmações que seguem.
Imagem associada para resolução da questão

( ) Esta montagem trata de um contador assíncrono.
( ) Para transformarmos a montagem em um contador decrescente basta utilizarmos a saída Q barrada.
( ) Neste tipo de contador o atraso não depende do número de bits, mas apenas da tecnologia utilizada. Por outro lado, como o atraso de propagação é menor, o contador síncrono pode trabalhar com frequências maiores que o contador assíncrono.

A

V, V e V

B

F, V e F

C

V, F e V

D

F, V e V

E

V, V e F

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Q752173

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUAP-UFF) |

Q752173 Engenharia Eletrônica

Considere o circuito digital a seguir para responder a esta questão. Sabe-se que as entradas A, B, C, D e E foram colocadas respectivamente em níveis lógicos 0, 1, 0, 1, 0. Com base nessa informação o valor em decimal apresentado nas três saídas vale o descrito na alternativa: Imagem associada para resolução da questão

A

Quatro

B

Sete

C

Três

D

Cinco

E

Seis

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Q752172

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUAP-UFF) |

Q752172 Engenharia Eletrônica

Considerando a mesma expressão da questão anterior, podemos representá-la de outra forma mais simples, considerando as portas lógicas básicas.

A

Sim, através de uma porta XOR de duas entradas

B

Sim, através de uma única porta OR de duas entradas

C

Não podemos representá-la de outra forma pois não cabe simplificação

D

Sim, através de uma única porta NAND de duas entradas

E

Sim, através de uma porta NXOR de duas entradas

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Q752171

Ano: 2016 Banca: IBFC Órgão: EBSERH Prova: IBFC - 2016 - EBSERH - Engenheiro Eletricista (HUAP-UFF) |

Q752171 Engenharia Eletrônica

Considere a expressão a seguir e escolha a alternativa que represente a quantidade de portas lógicas discretas necessárias à sua implementação. Observação: Portas Lógicas Discretas: AND (2 inputs), OR (2 inputs) e NOT.
Imagem associada para resolução da questão

A

Oito portas

B

Nove portas

C

Sete portas

D

Seis portas

E

Cinco portas

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Q747668

Ano: 2016 Banca: FCC Órgão: ELETROBRAS-ELETROSUL Prova: FCC - 2016 - ELETROBRAS-ELETROSUL - Técnico de Manutenção de Proteção e Apoio à Operação |

Q747668 Engenharia Eletrônica

Considere a figura abaixo.

Imagem associada para resolução da questão

Tendo em vista a lógica binária por meio da qual os controladores lógicos programáveis operam, os símbolos apresentados por I e II, representam, correta e respectivamente:

A

NOT − OR.

B

OR − AND.

C

AND − STOP.

D

SELECT − NOT.

E

FIELD − LEVEL.

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Q743385

Ano: 2016 Banca: FUNDEP (Gestão de Concursos) Órgão: IFN-MG Prova: FUNDEP (Gestão de Concursos) - 2016 - IFN-MG - Técnico em Eletrotécnica |

Q743385 Engenharia Eletrônica

Numere a COLUNA II de acordo com a COLUNA I, associando cada uma das funções lógicas à sua correspondente na linguagem Ladder.

Imagem associada para resolução da questão

Assinale a sequência CORRETA.

A

1 5 3 6 4 2 7

B

3 6 1 4 2 7 5

C

5 2 7 3 1 4 6

D

7 1 5 2 6 3 4

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Q743383

Ano: 2016 Banca: FUNDEP (Gestão de Concursos) Órgão: IFN-MG Prova: FUNDEP (Gestão de Concursos) - 2016 - IFN-MG - Técnico em Eletrotécnica |

Q743383 Engenharia Eletrônica

Analise o circuito a seguir, considerando que todas as entradas J e K estão em nível 1.

Imagem associada para resolução da questão

Com relação ao funcionamento desse circuito, é correto afirmar:

A

A cada pulso de CLOCK, os flip-flop JK alternam, simultaneamente, sua saída na borda de subida do pulso de CLOCK.

B

A saída B apresenta um glitch provocado pela ocorrência do estado “110”, produzindo um flash no LED ou display nela conectada.

C

O contador vai ao estado temporário “000” permanecendo nessa condição durante dois ciclos completos do CLOCK.

D

Um contador de módulo 6 é obtido pelo acionamento do CLEAR de um contador de módulo 8, quando a contagem atinge o número seis.

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Q743382

Ano: 2016 Banca: FUNDEP (Gestão de Concursos) Órgão: IFN-MG Prova: FUNDEP (Gestão de Concursos) - 2016 - IFN-MG - Técnico em Eletrotécnica |

Q743382 Engenharia Eletrônica

Minimize a função f (A, B, C, D) representada pelo mapa de Karnaugh a seguir.

Imagem associada para resolução da questão

A saída S dessa função é:

A

B

C

D

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Q732784

Ano: 2016 Banca: INSTITUTO AOCP Órgão: EBSERH Prova: INSTITUTO AOCP - 2016 - EBSERH - Engenheiro Eletricista (CH-UFPA) |

Q732784 Engenharia Eletrônica

Assinale a alternativa correta em relação ao seguinte circuito lógico MSI.

Imagem associada para resolução da questão

A

Mostra um contador de décadas do tipo Johnson de 8 bits.

B

Apresenta lógica sequencial com Flip-Flops do tipo D.

C

Corresponde a um decodificador de 3 para 8, em que as saídas são ativas em nível baixo.

D

É um CPLD programado em VHDL projetado para controlar um teclado serial no protocolo I²C sob padrão elétrico centronix paralelo.

E

As saídas A, B e C dependem das entradas Y0 a Y7 e dos pulsos de clock no terminal G1 em nível baixo.

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Q732776

Ano: 2016 Banca: INSTITUTO AOCP Órgão: EBSERH Prova: INSTITUTO AOCP - 2016 - EBSERH - Engenheiro Eletricista (CH-UFPA) |

Q732776 Engenharia Eletrônica

Em um projeto de eletrônica embarcada, um Engenheiro Eletricista encontrou um dispositivo lógico programável e, em sua análise, deve concluir sobre seu funcionamento para interpretar as funções previstas para ele. Com base nos conceitos de dispositivos lógico programáveis, assinale a alternativa correta.

A

Todos os dispositivos GAL (Lógica de Arranjo Genérico) apresentam matriz de termos de saída, portas XOR, cristal ressonante programável e microcélulas de lógica de entrada em sua arquitetura interna.

B

Os PLDs (Dispositivos Lógico Programáveis) são dispositivos programáveis que utilizam exclusivamente flip-flops do tipo D para implementar o registrador na macrocélula.

C

A Macrocélula da Lógica de Saída (OLMC) não pode ser programada para complementar o bit resultante.

D

A arquitetura interna de todos os dispositivos PAL (Lógica de Arranjo Programável) utiliza ULA com ADC de 16 bits e filosofia CISC em dois barramentos, sendo um de dados e outro de instruções, conforme tecnologia Harvard.

E

A PAL (Lógica de Arranjo Programável) apresenta estrutura AND e OR, porém as entradas das portas AND são programáveis.

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Q732774

Ano: 2016 Banca: INSTITUTO AOCP Órgão: EBSERH Prova: INSTITUTO AOCP - 2016 - EBSERH - Engenheiro Eletricista (CH-UFPA) |

Q732774 Engenharia Eletrônica

De acordo com a figura a seguir, assinale a alternativa correta com relação aos circuitos lógicos combinacionais.
Imagem associada para resolução da questão

A

A expressão no terminal OUT é OUT = + .

B

A expressão no terminal OUT é OUT = + .

C

A expressão no terminal OUT é OUT = + .

D

A expressão no terminal OUT é OUT =

+

.

E

A expressão no terminal OUT é OUT = +

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Q725789

Ano: 2016 Banca: IBFC Órgão: EMDEC - SP Prova: IBFC - 2016 - Emdec - Técnico em Manutenção Eletroeletrônica Jr |

Q725789 Engenharia Eletrônica

Você está verificando o diagrama lógico de um semáforo, e se deparou com a situação do circuito digital a seguir. Se levarmos os sinais A, B, C e D respectivamente para os níveis lógicos 1, 0, 1 e 0, teremos respectivamente as saídas S3, S2, S1 e S0 indicada na alternativa: Imagem associada para resolução da questão

A

0, 1, 0 e 1

B

1, 1, 0 e 1.

C

1, 0, 0 e 1.

D

1, 1, 1 e 0.

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Q725175

Ano: 2016 Banca: IF-TO Órgão: IF-TO Prova: IF-TO - 2016 - IF-TO - Técnico em Eletroeletrônica |

Q725175 Engenharia Eletrônica

O circuito digital a seguir contém 3 entradas “A”, “B” e “C” e uma saída “S”. Assinale a alternativa que contém a tabela-verdade correta relativa ao funcionamento de tal circuito. Imagem associada para resolução da questão

A

B

C

D

E

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Q725174

Ano: 2016 Banca: IF-TO Órgão: IF-TO Prova: IF-TO - 2016 - IF-TO - Técnico em Eletroeletrônica |

Q725174 Engenharia Eletrônica

A figura a seguir contém um circuito digital desconhecido, com 3 entradas “A”, “B” e “C”, e uma saída “S”. Baseado na tabela-verdade apresentada, indique a alternativa que contém a expressão lógica mais simplificada correspondente a tal circuito. Imagem associada para resolução da questão