Questões de Engenharia Eletrônica - Álgebra Booleana e Circuitos Lógicos em Engenharia Eletrônica para Concurso - Página 11

Q830550

Ano: 2017 Banca: FADESP Órgão: COSANPA Prova: FADESP - 2017 - COSANPA - Engenheiro Eletricista |

Q830550 Engenharia Eletrônica

A tabela verdade para a portal lógica que é mostrada na figura abaixo é

Imagem associada para resolução da questão

A

A 0 0 1 1

B 0 1 0 1

Y 0 1 1 1

B

A 0 0 1 1

B 0 1 0 1

Y 1 1 1 1

C

A 0 0 1 1

B 0 1 0 1

Y 1 1 0 0

D

A 0 0 1 1

B 0 1 0 1

Y 0 1 0 1

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Q815849

Ano: 2017 Banca: FUNRIO Órgão: SESAU-RO Prova: FUNRIO - 2017 - SESAU-RO - Técnico em Aparelho e Equipamentos Hospitalares |

Q815849 Engenharia Eletrônica

No projeto de circuitos lógicos combinacionais, o método gráfico utilizado para simplificar uma expressão lógica, ou para converter uma tabela-verdade em um circuito lógico mais simplificado, é denominado de:

A

flip-Flop.

B

curva de Morgan.

C

triângulo de Pascal.

D

mapa de Karnaugh.

E

álgebra booleana.

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Q815847

Ano: 2017 Banca: FUNRIO Órgão: SESAU-RO Prova: FUNRIO - 2017 - SESAU-RO - Técnico em Aparelho e Equipamentos Hospitalares |

Q815847 Engenharia Eletrônica

Mostra-se, a seguir, a tabela verdade de uma porta lógica, onde “A” e “B” indicam as entradas e “S” indica a saída. Imagem associada para resolução da questão

Essa porta lógica é do tipo:

A

OR.

B

AND.

C

NOR.

D

NAND.

E

XOR.

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Q807596

Ano: 2017 Banca: IFB Órgão: IFB Prova: IFB - 2017 - IFB - Professor - Mecatrônica |

Q807596 Engenharia Eletrônica

Para o circuito digital abaixo, defina qual é identificação das tensões V1, V2, V3, V4, V5 e V6 de entrada deste circuito com base na tabela apresentada.
Imagem associada para resolução da questão

Assinale a alternativa que apresenta a sequência CORRETA de identificação das tensões de entrada do circuito.

A

V5 = VA, V6 = VB, V1 = VC, V2 = VC, V3 = 5 V, V4 = 0

B

V5 = VA, V6 = VB, V1 = 0, V2 = VC, V3 = 0, V4 = 5 V

C

V5 = VA, V6 = VB, V1 = VC, V2 = VC, V3 = 0, V4 = 0

D

V5 = VA, V6 = VB, V1 = VC, V2 = VC, V3 = 5 V, V4 = 5 V

E

V5 = VA, V6 = VB, V1 = VC, V2 = 0, V3 = 5 V, V4 = 0

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Q805896

Ano: 2017 Banca: FUNDEP (Gestão de Concursos) Órgão: UFVJM-MG Prova: FUNDEP (Gestão de Concursos) - 2017 - UFVJM-MG - Técnico em Eletroeletrônica |

Q805896 Engenharia Eletrônica

Analise o circuito, admitindo o uso de portas TTL e as saídas ABCD inicialmente zeradas. Imagem associada para resolução da questão

Após 5 pulsos de relógio, o estado das saídas ABCD é igual a:

A

1101

B

0101

C

1010

D

0011

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Q805894

Ano: 2017 Banca: FUNDEP (Gestão de Concursos) Órgão: UFVJM-MG Prova: FUNDEP (Gestão de Concursos) - 2017 - UFVJM-MG - Técnico em Eletroeletrônica |

Q805894 Engenharia Eletrônica

No circuito R₁ = 10 KΩ e X_L1= 10 KΩ.

Imagem associada para resolução da questão

A impedância do circuito RL vista pela fonte de tensão é igual a:

A

5 KΩ ∠ 45°

B

20 KΩ ∠ 90°

C

7,1 KΩ ∠ -45°

D

5 KΩ ∠ 90°

Q800983

Ano: 2017 Banca: FUNDEP (Gestão de Concursos) Órgão: UFVJM-MG Prova: FUNDEP (Gestão de Concursos) - 2017 - UFVJM-MG - Técnico em Tecnologia da Informação |

Q800983 Engenharia Eletrônica

Qual porta lógica está sendo representada a seguir?

Imagem associada para resolução da questão

A

NAND

B

AND

C

OR

D

XOR

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Q796188

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796188 Engenharia Eletrônica

Os circuitos lógicos podem ser ligados uns nos outros formando blocos lógicos, porém deve ser observado o FAN-OUT (feixe de saída) que estipula o limite dessas ligações. Assinale a alternativa que indica o que pode acontecer se este limite for excedido.

A

Se esse fator for excedido na ligação da saída de um bloco às entradas de outros, os limites máximos de corrente serão ultrapassados, porém nada acontece, pois se trata de circuito digital

B

Se esse fator for excedido na ligação da saída de um bloco às entradas de outros, devem ser usados capacitores para compensar a perda

C

Se esse fator for excedido na ligação da saída de um bloco às entradas de outros, devem ser usados circuitos ativos para compensar a perda

D

Se esse fator for excedido na ligação da saída de um bloco às entradas de outros, os limites máximos de corrente serão ultrapassados, acarretando principalmente a queda do nível 1 de saída

E

Se esse fator for excedido na ligação da saída de um bloco às entradas de outros, deve ser aumentada a tensão de alimentação para compensar a perda

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Q796187

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796187 Engenharia Eletrônica

O circuito abaixo representa um conversor Digital-Analógico com chave seletora digital, qual é a expressão que representa a saída Vs: Imagem associada para resolução da questão

A

Vs=-((V.1k)/R)*(A+(B/2)+(C/4)+(D/8))

B

Vs=-((V.2k)/R)*(A+(B/2)+(C/4)+(D/8))

C

Vs=-((V.4k)/R)*(A+(B/2)+(C/4)+(D/8))

D

Vs=-((V.8k)/R)*(A+(B/2)+(C/4)+(D/8))

E

Vs= ((V/R)*(A+(B/3)+(C/4)+(D/8))

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Q796186

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796186 Engenharia Eletrônica

Os Flip-flops podem ter arranjos para diversas finalidades. Por exemplo, na modalidade de contador, o tipo Contador assíncrono também é conhecido como se descreve na alternativa:

A

JLK

B

Astável

C

Monoestável

D

Ripple

E

Biestável

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Q796185

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796185 Engenharia Eletrônica

Nos circuitos digitais, é comum o termo “Contadores”. Assinale a alternativa que define o termo em questão.

A

São circuitos construídos a partir de AmpOp; eles garantem um estado fixo, sem a necessidade de um sinal clock

B

São circuitos analógicos que garantem um estado fixo para um sistema digital

C

São circuitos digitais que garantem um estado fixo, sem a necessidade de um clock

D

São circuitos digitais que variam seus estados, sem a necessidade de um clock

E

São circuitos digitais que variam seus estados, sob o comando de um clock, de acordo com uma sequência predeterminada

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Q796184

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796184 Engenharia Eletrônica

Dado o circuito a seguir, assinale a alternativa que apresenta a resposta correspondente à saída F. Imagem associada para resolução da questão

A

F= (B’xCxD)+(AxBxD’)+(A’xCxD)+(AxBxC’)

B

F= (B’xCxD)+(AxCxD’)+(A’xC’xD)+(AxBxC’)

C

F= (A’xCxD)+(AxBxD’)+(A’xBxD)+(AxBxC’)

D

F= (B’xCxD)+(AxB’xD’)+(A’xCxD)+(AxBxC’)

E

F= (A’xC’xD)+(AxBxD’)+(A’xCxD)+(AxBxD’)

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Q796183

Ano: 2017 Banca: IBFC Órgão: POLÍCIA CIENTÍFICA-PR Prova: IBFC - 2017 - POLÍCIA CIENTÍFICA-PR - Perito Criminal - Área 4 |

Q796183 Engenharia Eletrônica

Chamamos de “Tabela Verdade” um mapa em que colocamos todas as possíveis situações com seus respectivos resultados. Segundo a tabela verdade abaixo, identifque que tipo de porta lógica representa, sendo A e B entradas e Q a saída. Imagem associada para resolução da questão

A

Porta lógica OR

B

Porta lógica AND

C

Porta lógica NAND

D

Porta lógica NOR

E

Porta lógica XOR

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Q788573

Ano: 2017 Banca: UFMT Órgão: UFSBA Prova: UFMT - 2017 - UFSBA - Engenheiro Eletricista |

Q788573 Engenharia Eletrônica

O mapa de Karnaugh é um método gráfico usado para simplificar uma equação lógica ou para converter uma tabela verdade no seu circuito lógico correspondente, de uma forma simples e metódica. Utilizando o mapa de Karnaugh, qual alternativa apresenta a simplificação para a tabela verdade de quatro entradas A,B,C,D e uma saída (S) ao lado?
Imagem associada para resolução da questão

A

B

C

D

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Q786393

Ano: 2017 Banca: CONSULPLAN Órgão: TRF - 2ª REGIÃO Prova: CONSULPLAN - 2017 - TRF - 2ª REGIÃO - Analista Judiciário - Engenharia Eletrônica |

Q786393 Engenharia Eletrônica

O circuito a seguir é um circuito combinacional muito comum em sistemas digitais. Analise-o. Imagem associada para resolução da questão

____ ____
Para que a saída Y7 esteja em nível lógico baixo, os sinais A, B, C, G1, G2A e G2B devem ser, respectivamente:

A

0, 0, 0, 1, 0, 0.

B

1, 1, 1, 1, 0, 0.

C

0, 0, 0, 1, 0, 1.

D

0, 0, 0, 1, 1, 1.

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Q786381

Ano: 2017 Banca: CONSULPLAN Órgão: TRF - 2ª REGIÃO Prova: CONSULPLAN - 2017 - TRF - 2ª REGIÃO - Analista Judiciário - Engenharia Eletrônica |

Q786381 Engenharia Eletrônica

A tabela representada pela figura anterior possui características elétricas de uma porta lógica da família TTL74LS. A margem de ruído para nível lógico alto é:

A

0,7V.

B

2,5V.

C

0,25V.

D

0,35V.

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