Questões de Concurso Sobre flip-flops em engenharia eletrônica
Foram encontradas 111 questões
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Ano: 2017
Banca:
IF-PE
Órgão:
IF-PE
Prova:
IF-PE - 2017 - IF-PE - Técnico de laboratório – Eletroeletrônica |
Q771578
Engenharia Eletrônica
No circuito da Figura 07, o sinal na entrada de clock tem frequência igual a 1 kHz. Na saída Q,
o sinal terá uma frequência igual a:
Q725172
Engenharia Eletrônica
Sobre circuitos digitais sequenciais, assinale a
alternativa incorreta.
Ano: 2010
Banca:
CESPE / CEBRASPE
Órgão:
TRE-BA
Prova:
CESPE - 2010 - TRE-BA - Técnico Judiciário - Telecomunicações e Eletricidade |
Q718773
Engenharia Eletrônica
Com relação a sistemas e dispositivos digitais, julgue o item seguinte.
No flip-flop JK do tipo mestre-escravo, se as entradas J e K
estiverem todo o tempo conectadas ao nível lógico 1, então a
saída Q, após sucessivos ciclos de relógio, permanecerá no
nível lógico 1.
Ano: 2015
Banca:
INSTITUTO AOCP
Órgão:
EBSERH
Prova:
INSTITUTO AOCP - 2015 - EBSERH - Engenheiro Eletricista (HC-UFG) |
Q717920
Engenharia Eletrônica
Um processo industrial necessita determinar o número de voltas de um motor trifásico. Para tal função,
decidiu-se utilizar um encoder de 256 passos e um contador síncrono montado a partir de Flip-Flops.
A cada 256 passos do encoder, o motor dava uma volta completa. Sabendo que o Flip-Flop utilizado
possui um 
(micro segundo) para o tempo de propagação, e que o contador deve contar 2
voltas, assinale a alternativa correta.
(micro segundo) para o tempo de propagação, e que o contador deve contar 2
voltas, assinale a alternativa correta.
Ano: 2015
Banca:
FCC
Órgão:
DPE-RR
Prova:
FCC - 2015 - DPE-RR - Engenheiro Eletrônico ou Mecatrônico |
Q593055
Engenharia Eletrônica
O circuito abaixo trata de um gerador de sequência, em anel, implementado com Flip Flop tipo D e porta lógica.
A sequência de loop, em numeração decimal, executada pelo gerador, é o que consta em