No programa de CLP apresentado, utilizando a linguagem FBD, ...

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Ano: 2022 Banca: IF-PA Órgão: IF-PA Prova: IF-PA - 2022 - IF-PA - Professor EBTT - Engenharia Eletrônica |

Q3998443 Engenharia Eletrônica

No programa de CLP apresentado, utilizando a linguagem FBD, é realizado um circuito biestável na saída Q0, comandado por duas entradas I0 e I1, uma destas permite ligar (ir para o estado alto 1) a saída Q0, e outra que permite desligar esta saída. O programa funciona da seguinte maneira

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A entrada I0 fica normalmente no nível alto 1, e a entrada I1 fica normalmente no nível baixo 0. Quando se aplica um pulso negativo em I0 (nível baixo 0 momentâneo), a saída Q0 vai para o nível alto (liga). Ao aplicarmos um pulso positivo na entrada I1, a saída Q0 desliga.

As entradas I0 e I1 ficam normalmente no nível alto 1, quando se aplica um pulso negativo em I0 (nível baixo 0 momentâneo), a saída Q0 vai

As entradas I0 e I1 ficam normalmente no nível baixo 0. Quando se aplica um pulso positivo em I0 (nível alto 1 momentâneo), a saída Q0 vai para o nível alto. Ao aplicarmos um pulso positivo na entrada I1, a saída Q0 desliga.

A entrada I0 fica normalmente no nível alto 1, e a entrada I1 fica normalmente no nível baixo 0. Quando se aplica um pulso negativo em I0, a saída Q0 vai para o nível baixo. Ao aplicarmos um pulso positivo na entrada I1, a saída Q0 liga.

A entrada I0 fica normalmente no nível baixo 0, e a entrada I1 fica normalmente no nível alto 1. Quando se aplica um pulso positivo (nível alto 1 momentâneo) na entrada I0, a saída Q0 vai para o nível alto. Ao aplicarmos um pulso negativo na entrada I1, a saída Q0 desliga.

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