Questões de Concurso Sobre arquitetura de computadores

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Q220535 Arquitetura de Computadores
Em relação a memória cache do processador (cache memory), analise:

I. A memória cache é uma memória rápida que armazena partes da memória principal, para fornecer um rápido acesso às informações mais utilizadas.

II. Quando o processador necessita efetuar a leitura de alguma região de memória, ele primeiramente verifica se a informação referente a essa área se encontra na memória cache.

III. Alguns processadores implementam o Trace Cache, que é um tipo de memória cache que armazena instruções já decodificadas, prontas para serem processadas.

É correto o que consta em


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Q220534 Arquitetura de Computadores
O barramento PCI Express (PCIe) foi desenhado para substituir os antigos barramentos PCI, bem como o AGP. Este barramento pode fornecer altas taxas de transferência, e em sua versão 3.0 essa taxa é de até
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Q220533 Arquitetura de Computadores
No barramento firewire (IEEE 1394) é possível obter taxas de transferência próximas ao do USB 2.0, algo em torno de 400 Mb/s. Devido às suas características elétricas, os cabos utilizados nessa transmissão (sem repetidoras ou hubs) devem ter no máximo
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Q220532 Arquitetura de Computadores
Em USB 2.0, o esquema elétrico garante que controladores de host e hubs forneçam recursos para que velocidade total e baixa velocidade possam ser transmitidas entre o host e o dispositivo, ainda que entre o host e o hub se mantenha alta velocidade. Essa transmissão é efetuada por um cabo contendo
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Q220531 Arquitetura de Computadores
A taxa de transferência especificada para transmissões via barramento USB, conforme descrito em sua especificação 2.0, no modo de alta velocidade é de
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Q220530 Arquitetura de Computadores
O barramento AGP (Accelerated Graphics Port) é utilizado para conectar uma placa de aceleração gráfica para o processamento de imagens. Uma das vantagens desse barramento é a grande capacidade de transferência de dados, chegando a transmitir mais de 2MB por segundo a um clock de
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Q216003 Arquitetura de Computadores
No contexto da organização de sistemas de computadores,

I. o ciclo busca-decodificação-execução pode ser executado, também, por um interpretador de software que roda em um nível mais baixo.

II. computadores paralelos incluem processadores matriciais, nos quais a mesma operação é efetuada sobre múltiplos conjuntos de dados ao mesmo tempo.

III. computadores paralelos incluem multiprocessadores, nos quais várias CPUs compartilham uma memória em comum.

IV. computadores paralelos podem ser formados por multicomputadores, cada um com sua própria memória, mas se comunicando por transmissão de mensagens.

Está correto o que afirma em
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Q215852 Arquitetura de Computadores
No contexto dos sistemas de arquivos, para se ter acesso aleatório aos arquivos, é necessário um método para especificar onde estão os dados. A chamada ao sistema que reposiciona o ponteiro para um local específico do arquivo é denominada
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Q215850 Arquitetura de Computadores
Na interação entre o sistema operacional e dispositivos de E/S,
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Q215849 Arquitetura de Computadores
Sobre barramento USB é correto afirmar:
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Q215064 Arquitetura de Computadores
Sobre LVM é INCORRETO afirmar:
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Q215063 Arquitetura de Computadores
Em relação aos modelos de entrada e saída, considere:

I. Na entrada e saída mapeada, o programa vê os dispositivos periféricos como endereços de memória, mandando dados para eles como se estivesse escrevendo na memória.

II. No modo de transferência simples o controlador de DMA devolve o controle de barramento à CPU a cada transferência de um byte (ou palavra); no modo de transferência por bloco o controlador de DMA não devolve o controle do barramento à CPU até que toda a transferência tenha sido efetuada.

III. Na entrada e saída mapeada, se cada dispositivo tem seus registradores de controle em uma página diferente do espaço de endereçamento, o sistema operacional pode dar a um usuário o controle sobre dispositivos específicos, simplesmente incluindo as páginas desejadas em sua tabela de páginas.

IV. Os controladores de DMA que usam endereçamento de memória física para suas transferências requerem que o sistema operacional converta o endereço virtual do buffer de memória pretendido em um endereço físico e escreva esse endereço físico no registrador de endereço do DMA.

Está correto o que se afirma em

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Q215061 Arquitetura de Computadores
É uma memória não volátil, utilizada tanto em leitura quanto em escrita e pode ser apagada sem ser removida do circuito; seus tipos são NOR e NAND:
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Q215060 Arquitetura de Computadores
Os computadores manipulam tanto números positivos quanto números negativos, que são representados em complemento a 2. Dado o número binário 01111101, o complemento a 2 resultante será
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Q215059 Arquitetura de Computadores
No contexto do módulo executável de um programa de computador, menor tempo de execução, menor consumo de memória, maior tempo na execução de loop’s, e menor dificuldade de identificação de erros estão associados, respectivamente, aos métodos
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Q215058 Arquitetura de Computadores
É um item que NÃO integra um pipeline de cinco estágios:
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Q215051 Arquitetura de Computadores
Somando-se os hexadecimais D45 e F133, os resultados correspondentes no sistema decimal e no binário serão, respectivamente,
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Q213480 Arquitetura de Computadores
Considere:
Imagem 008.jpg
É correto afirmar que os CPIs para cada sequência, 1 e 2, são, respectivamente,

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Q213166 Arquitetura de Computadores
Segundo Andrew S. Tanenbaum, numa conjugação de hardware, linguagens interpretadas e linguagens traduzidas, o computador pode ser dividido em uma máquina de seis níveis. Em um desses níveis, os objetos mais interessantes são denominados PORTAS, cada uma, contendo uma ou mais entradas para sinais digitais (representando 0 ou 1) e computando como saída alguma função simples dessas entradas, como AND ou OR . Trata-se do nível de arquitetura
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Ano: 2011 Banca: CESGRANRIO Órgão: BR Distribuidora
Q1235260 Arquitetura de Computadores
Um computador possui uma capacidade máxima de memória principal com 64K células, cada uma capaz de armazenar uma palavra de 8 bits. Quais são o maior endereço em decimal dessa memória e o tamanho do barramento de endereços desse sistema, respectivamente? 
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Respostas
6701: C
6702: E
6703: B
6704: A
6705: C
6706: E
6707: E
6708: D
6709: B
6710: A
6711: D
6712: E
6713: E
6714: E
6715: E
6716: E
6717: E
6718: B
6719: A
6720: D