Questões de Arquitetura de Computadores para Concurso - Página 127

Q2112580

Ano: 2022 Banca: Instituto Consulplan Órgão: SEED-PR Prova: Instituto Consulplan - 2022 - SEED-PR - Eixo Tecnológico: Informação e Comunicação |

Q2112580 Arquitetura de Computadores

Desde que surgiram, os computadores têm passado por constantes evoluções, seja na questão do hardware e também no software, uma vez que a evolução de um acompanha o outro e vice-versa. Como marco da arquitetura de computadores, estes podem ser considerados como gerações. Uma dessas gerações tem como características as válvulas; trata-se da geração:

A

Zero.

B

Primeira.

C

Segunda.

D

Terceira.

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Q2112579

Ano: 2022 Banca: Instituto Consulplan Órgão: SEED-PR Prova: Instituto Consulplan - 2022 - SEED-PR - Eixo Tecnológico: Informação e Comunicação |

Q2112579 Arquitetura de Computadores

Em computação dois sistemas de numeração são considerados base: binário, que é a linguagem que os computadores entendem, e hexadecimal, bastante usado em redes, principalmente com a entrada do Protocolo de Internet, versão 6, ou IPv6 (Internet Protocol version 6). O binário é a base da computação; endereços IPv4 (Internet Protocol version 4 – Protocolo de Internet versão 4) podem ser representados dessa forma também. Como exemplo de IPv4, tem-se o seguinte endereço reservado: [192.168.100.55]. Assinale a alternativa que representa o respectivo endereço em linguagem binária.

A

11001000.10101001.1101100.101111

B

11001110.10111000.1100100.100111

C

11000000.10101000.1100100.110111

D

11000001.10101100.1110100.110101

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Q2112150

Ano: 2022 Banca: Instituto Consulplan Órgão: SEED-PR Prova: Instituto Consulplan - 2022 - SEED-PR - Eixo Tecnológico: Controle e Processos Industriais |

Q2112150 Arquitetura de Computadores

Considerando os sistemas microprocessados, relacione adequadamente as colunas quanto à classificação.
1. Sistema microprocessado com hardware para aritmética de ponto flutuante. 2. Sistema microprocessado com hardware sem adaptação para aritmética de ponto flutuante.
( ) Tiva – Cortex M4. ( ) Arduino. ( ) FPGA. ( ) Microcontroladores PIC. ( ) Processadores digitais de sinais.
A sequência correta está em

A

1, 1, 1, 2, 2.

B

2, 1, 1, 1, 2.

C

1, 2, 2, 2, 1.

D

2, 1, 2, 1, 1.

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Q2109481

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109481 Arquitetura de Computadores

Uma forma de reduzir o tempo de acesso à memória no esquema de paginação é adicionar uma memória cache especial que vai manter as entradas da tabela de páginas mais recentemente utilizadas. O acesso a essa cache é rápido e não degrada o tempo de acesso à memória como um todo. Essa memória cache, interna à Memory Management Unit (MMU), também chamada de memória associativa, é a

A

Page Table Base Register.

B

Translation Lookaside Buffer.

C

Memory Lookaround Buffer.

D

Page Table Limit Register.

E

Translation Limited Base Register.

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Q2109473

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109473 Arquitetura de Computadores

Uma comutação por circuitos

A

não exige o estabelecimento de um circuito dedicado para a comunicação, o que implica menores custos com meios físicos.

B

exige que as estações comunicantes possuam um caminho dedicado exclusivo que pode ser estabelecido por Capacity Division Multicasting e Statistical Method Division Multiplexing.

C

exige que as estações comunicantes possuam um caminho dedicado exclusivo que pode ser estabelecido por Timing Division Multiplexing e Statistical eXclusive Division Multiplexing.

D

exige que as estações comunicantes possuam um caminho dedicado exclusivo que pode ser estabelecido por Physical Circuit e Multiplexing Time Division.

E

exige que as estações comunicantes possuam um caminho dedicado exclusivo que pode ser estabelecido por Frequency Division Multiplexing e Time Division Multiplexing.

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Q2109472

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109472 Arquitetura de Computadores

Para aplicar como meio de transmissão na rede de computadores de sua organização, um Técnico verificou que o cabo coaxial grosso tem resistência, velocidade de transmissão e frequência, respectivamente, de

A

16 ohms, até 8 mbps, 2 Mhz.

B

50 ohms, até 8 mbps, 196 Mhz.

C

64 ohms, até 10 mbps, 196 Mhz.

D

75 ohms, até 10 mbps, 10 Ghz.

E

96 ohms, até 56 mbps, 16 Ghz.

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Q2109450

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109450 Arquitetura de Computadores

Considere a seguinte sequência de números: 3 5 1 7 2 6 4. Estes números foram:
I. armazenados em uma fila, nesta ordem; II. em seguida, estes números foram retirados um a um desta fila e foram armazenados em uma pilha; III. logo após, estes números foram desempilhados um a um e armazenados em uma árvore binária de pesquisa de altura mínima.
É correto afirmar que

A

em II o primeiro número a sair da fila resultante foi 4.

B

em II o último número empilhado foi 3.

C

a altura da árvore resultante em III, considerando-se a raiz no nível 1, é 4.

D

a fila é conhecida como uma lista LIFO – Last In First Out.

E

a raiz da árvore resultante em III é 4.

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Q2109449

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109449 Arquitetura de Computadores

Em uma máquina endereçável por byte, o menor dado que pode ser referenciado na memória RAM é o byte. Neste tipo de máquina,

A

a palavra tem 2⁸ bytes.

B

quando palavras de múltiplos bytes são usadas, a ordem na qual os bytes são armazenados na memória não é importante.

C

o número 0A0B0C0D₁₆, que ocupa múltiplos bytes, poderia ser armazenado como 0D 0C 0B 0A, caso a ordem dos bytes esteja no modelo little-endian, ou como 0A 0B 0C 0D, caso esteja no modelo big-endian.

D

palavras de múltiplos bytes devem ser armazenadas no modelo short-endian, em que o byte mais significativo fica no endereço mais baixo da memória.

E

palavras de múltiplos bytes devem ser armazenadas no modelo tall-endian, em que o byte menos significativo é armazenado no endereço mais baixo da memória.

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Q2109447

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Técnico Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2109447 Arquitetura de Computadores

Em um sistema com multiprocessamento assimétrico

A

os processadores compartilham a mesma memória.

B

os processadores trabalham com processos de uma fila pronta comum ou pode haver uma fila privada pronta para cada processador.

C

se um dos processadores falhar, a capacidade de computação do sistema será reduzida.

D

o processador mestre controla a estrutura de dados, realizando a distribuição de processos entre os processadores escravos, fazendo o processamento de I/O, dentre outras atividades.

E

todos os processadores possuem a mesma arquitetura e precisam ser sincronizados para se manter o equilíbrio de carga.

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Q2108857

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Analista Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2108857 Arquitetura de Computadores

Em um processador, o tempo T gasto no processamento de M instruções em um pipeline com K estágios, sendo M muito maior que K, e tempo de ciclo de máquina igual a t, é dado por: T = M * t.
Considere que programa tem 1.000.000 (M) de instruções. Em uma arquitetura sem pipeline, o tempo médio de execução de cada instrução (t1) é 6,5 ns. Nesta arquitetura, o tempo gasto no processamento das M instruções é: T1 = 6,5 ns * 1.000.000 ≅ 6,5 ms. O ganho (T1/T2) na execução deste programa em um processador com pipeline de 5 estágios com ciclo de 2 ns (t2) é:

A

2 ms

B

2

C

3,25 ms

D

3,25

E

16,25

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Q2108856

Ano: 2022 Banca: FCC Órgão: TRT - 19ª Região (AL) Prova: FCC - 2022 - TRT - 19ª Região (AL) - Analista Judiciário - Área Apoio Especializado Especialidade: Tecnologia da Informação |

Q2108856 Arquitetura de Computadores

Os processadores utilizam, para realizar a aritmética computacional de números inteiros, a representação de ponto fixo. Considerando o número 10₁₀, cuja representação binária com 8 bits é 00001010, é correto afirmar:

A

00001010₂ é representado em complemento de um por 11110101₂

B

-10₁₀é representado na notação sinal-magnitude por 11110110₂

C

-10₁₀ é representado na notação complemento de dois por 10001010₂

D

10₁₀ é representado na notação sinal-magnitude por 10001010₂

E

00001010₂somado a 011₂ resulta em 00001111₂

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Q2105279

Ano: 2022 Banca: FCC Órgão: PGE-AM Prova: FCC - 2022 - PGE-AM - Técnico em Gestão Procuratorial Especialidade Informática |

Q2105279 Arquitetura de Computadores

Em relação aos fundamentos das linguagens de programação, é correto afirmar:

A

Um dos desafios da tradução de programas escritos em linguagens de alto nível para programas em linguagem assembler é minimizar a quantidade de variáveis mapeadas em registradores e, com isso, melhorar o desempenho do programa. Os compiladores são capazes de fazer esta tarefa muito bem, porém o resultado final depende muito da quantidade de registradores que estão disponíveis na arquitetura alvo.

B

Cada vez é mais incomum encontrar programas úteis que usam poucas variáveis. Quando ocorre uma atribuição a alguma variável de um programa de alto nível, esta atribuição é mapeada para o endereço da variável correspondente. Porém, como o acesso à memória é mais rápido do que o acesso a registradores, é mais eficiente mapear as variáveis em endereços de memória ROM.

C

Uma solução frequente para melhorar o desempenho dos processadores é anexar uma memória super rápida, próximo da CPU − a memória cache, cuja divisão em níveis torna a busca de informações do processador mais otimizada. Mas, como são muito mais caras, as memórias cache são normalmente pequenas.

D

Em um comando de repetição como “while (i<10)”, o laço deve ser interrompido quando a condição do laço for falsa. Em assembler, a instrução de desvio apropriada é algo como "desvie se i>10", ou seja, desvie se a expressão (i<=10) for falsa.

E

As linguagens de programação têm pelo menos dois tipos de comandos condicionais: if-then e if-then-else. Se a expressão testada for verdadeira, a sequência de comandos contida nos comandos assembler relativos ao “then” deve ser executada e, se for falsa, a sequência de comandos do “else” deve ser executada. Em situações particulares, os comandos do “then” e do “else” são executados consecutivamente.

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Q2104685

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico em Informática |

Q2104685 Arquitetura de Computadores

Um usuário relata um problema ao técnico de informática que, ao ligar o computador, “ele não inicia e nada aparece no vídeo”. O técnico em informática pediu para verificar se o computador está conectado à energia. O usuário verificou e confirmou que a máquina estava conectada a energia e, ainda, informou que o cooler da fonte girava e alguns beeps sonoros foram gerados. Diante do relato do usuário o provável componente do computador que está com problema é:

A

Fonte.

B

Memória.

C

Disco rígido.

D

Placa de rede.

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Q2104661

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico em Informática |

Q2104661 Arquitetura de Computadores

A aritmética computacional permite a manipulação de números, que podem representar as palavras de um computador, incluindo operações de soma, subtração, multiplicação e divisão. Ao executar a soma dos números binários 10101111 e 1000001001 é possível obter como resposta:

A

1010111000

B

1010101001

C

1110111000

D

1000100100

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Q2104660

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico em Informática |

Q2104660 Arquitetura de Computadores

Um sistema de numeração é formado por um conjunto de símbolos utilizados para representação de quantidades (alfabeto) e as regras que definem a forma de representação. Um sistema de numeração é determinado fundamentalmente pela sua base. O número 5784₍₁₀₎ é representado no sistema binário pelo número:

A

1010010011001

B

1011010011000

C

1010010011101

D

1011010011010

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Q2104659

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico em Informática |

Q2104659 Arquitetura de Computadores

Para que um computador funcione são necessários diversos componentes tanto de hardware quanto de software. “Componente do computador que consiste em um conjunto de locais, definidos por endereços numerados sequencialmente, onde cada local contém um número binário que pode ser interpretado como uma instrução ou um dado.” Trata-se de:

A

Módulo de memória.

B

Interpretador de instrução.

C

Registrador de buffer de E/S.

D

Módulo para funções aritméticas e lógicas.

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Q2104657

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico em Informática |

Q2104657 Arquitetura de Computadores

A arquitetura RISC (Computador com um Número Reduzido de Instruções) é uma arquitetura que usa um pequeno grupo de instruções e levam, praticamente, o mesmo tempo para serem processadas. São características da arquitetura RISC:

A

Instrução por ciclo; operações registrador-para-registrador; e, modos de endereçamento simples.

B

Instrução por ciclo; muitos modos de endereçamento; e, execução de centenas de instruções complexas de diferentes tipos.

C

Muitos modos de endereçamento; execução de centenas de instruções complexas de diferentes tipos; e, poucos registradores.

D

Muitos modos de endereçamento; operações registrador-para-registrador; e, execução de centenas de instruções complexas de diferentes tipos.

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Q2093457

Ano: 2022 Banca: CONSULPLAN Órgão: MPE-PA Prova: CONSULPLAN - 2022 - MPE-PA - Técnico – Analista de Sistemas – Suporte à Rede de Computadores |

Q2093457 Arquitetura de Computadores

Sobre os computadores RISC (Reduced Instruction Set Computer – Computador com Conjunto de Instruções Reduzido) e CISC (Complex Instruction Set Computer – Computador com Conjunto de Instruções Complexo), analise as afirmativas a seguir.
I. Na arquitetura CISC, o comprimento das instruções é fixo; no RISC, é variável.
II. O número de registradores no CISC é tipicamente baixo, de 1 a 8; no RISC, é tipicamente alto, de 64 a 128.
III. Na execução, as instruções o CISC tem baixa superposição; no RISC, é alta superposição baseada em pipeline.
Está correto o que se afirma apenas em

A

I.

B

II.

C

III.

D

I e II.

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Q2084089

Ano: 2022 Banca: UFSM Órgão: UFSM Prova: UFSM - 2022 - UFSM - Analista de Tecnologia da Informação |

Q2084089 Arquitetura de Computadores

Qual dos seguintes métodos de codificação de linha utilizados na transmissão digital é imune a problemas de sincronização, componentes DC (corrente contínua) e afastamento em relação à referência original, comuns quando há sequências longas de 1s ou 0s?

A

NRZ.

B

AMI.

C

MLT-3.

D

2B1Q.

E

Manchester.

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Q2083024

Ano: 2022 Banca: Avança SP Órgão: Câmara Municipal de Taboão da Serra - SP Prova: Avança SP - 2022 - Câmara Municipal de Taboão da Serra - SP - Técnico de Tecnologia da Informação |

Q2083024 Arquitetura de Computadores

Responda abaixo qual a única opção que não é um desses benefícios.
“O esquema básico de um processamento de dados (manual ou automático) resulta em um produto acabado: a informação. Assim, os dados precisam ser processados para que algum resultado tenha significado para alguém ou para o próprio computador. O computador processa os dados, orientado por um conjunto de instruções, para produzir resultados completos com um mínimo de intervenção humana. Entre seus vários benefícios.”

A

Grande velocidade no processamento e disponibilização de informações.

B

Precisão no fornecimento das informações.

C

Redução de custos operacionais.

D

Compartilhamento de dados.

E

Execução de tarefas alternativas e saltadas.

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Questões de Concurso Sobre arquitetura de computadores

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