Questões de Arquitetura de Computadores - Memória para Concurso - Página 49

Q61235

Ano: 2010 Banca: FCC Órgão: TRE-RS Prova: FCC - 2010 - TRE-RS - Técnico Judiciário - Programação de Sistemas |

Q61235 Arquitetura de Computadores

A Memory Controller HUB faz a ligação entre ..I.., a memória e a placa de vídeo (AGP ou PCI Express). O I/O Controller HUB controla ..II.. .

Para completar corretamente o texto as lacunas devem ser preenchidas, respectivamente, por:

A

I II
o barramento PCI o processador

B

I II
a placa de rede a porta USB

C

I II
o processador o barramento PCI

D

I II
o processador a placa mãe

E

I II
a placa mãe o processador

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Q61233

Ano: 2010 Banca: FCC Órgão: TRE-RS Prova: FCC - 2010 - TRE-RS - Técnico Judiciário - Programação de Sistemas |

Q61233 Arquitetura de Computadores

Os tipos de memória respectivamente associados às memórias DDR200 e DDR400 são:

A

PC1600 e PC2100.

B

PC1600 e PC3200.

C

PC2100 e PC1600.

D

PC2100 e PC3200.

E

PC2700 e PC3200.

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Q61231

Ano: 2010 Banca: FCC Órgão: TRE-RS Prova: FCC - 2010 - TRE-RS - Técnico Judiciário - Programação de Sistemas |

Q61231 Arquitetura de Computadores

Uma memória DDR400 tem a capacidade maior de realizar (em acessos por segundo)

A

800 mil.

B

8 milhões.

C

200 milhões.

D

400 milhões.

E

800 milhões.

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Q54273

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobrás - Técnico em Informática |

Q54273 Arquitetura de Computadores

Com o lançamento dos computadores 486, surgiu um problema, que foi a diferença entre a velocidade de cálculo dos processadores e a velocidade das memórias externas. Esse problema foi resolvido pelos engenheiros com a

A

criação de um novo tipo de memória externa, mais rápida, denominada EDO.

B

inclusão de mais slots para instalação de memórias na placa-mãe dos computadores.

C

instalação de uma pequena quantidade de memória RAM de alta velocidade denominada CACHE.

D

diminuição da velocidade final de cálculo dos processadores e o aumento do time-slice dos processos.

E

utilização de espaço no disco rígido para descarregar cálculos ainda não processados pela memória RAM.

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Q54272

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobrás - Técnico em Informática |

Q54272 Arquitetura de Computadores

Durante a digitação de um texto, antes que o mesmo fosse salvo no disco rígido, ocorreu uma queda de energia desligando o computador do usuário. Após esse acontecimento, o usuário consultou o técnico de informática sobre a possibilidade de recuperação do texto não salvo e obteve, como resposta, que não seria possível recuperar essas informações porque

A

os dados não salvos no disco rígido são considerados transitórios, e o computador não tem rotina de backup para os mesmos.

B

o disco rígido do computador apaga todas as informações recentes quando ocorre uma queda de energia.

C

a memória RAM, onde ficam armazenados os dados não salvos no disco rígido, é apagada cada vez que o computador é desligado.

D

as normas de segurança ISO não permitem que sejam recuperados dados não salvos pelo usuário.

E

os procedimentos lógicos para recuperar dados selados na memória do computador colocam em risco a integridade do equipamento.

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Q54271

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - Petrobrás - Técnico em Informática |

Q54271 Arquitetura de Computadores

Além das memórias RAM (Random Access Memory), os computadores possuem memórias ROM (Read Only Memory) em suas arquiteturas. Com relação a esses tipos de memória, tem-se que

A

EPROM é uma memória ROM programável mediante o uso de ultravioleta em uma pequena janela do chip, podendo ser reprogramada.

B

EEPROM é uma memória RAM programável eletricamente, podendo ser reprogramada por meio da BIOS do computador.

C

BIOS é uma parte da memória RAM programável mediante o uso de Raios infravermelhos ou laser.

D

FLASH BIOS é uma memória ROM não programável inclusa na BIOS por meio de um grampo elétrico.

E

MAIN BOARD é uma memória RAM não programável, mas com muita capacidade de processamento.

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Q51803

Ano: 2010 Banca: FCC Órgão: MPE-RN Prova: FCC - 2010 - MPE-RN - Analista de Tecnologia da Informação - Suporte Técnico |

Q51803 Arquitetura de Computadores

Uma das propriedades funcionais do barramento de um computador é a temporização, dividida em síncrona e assíncrona. Considerando um barramento síncrono com as seguintes características:

Envio do endereço para a memória: 5 ns
Leitura da memória: 20 ns
Envio do dado para o dispositivo: 5 ns
Largura do barramento: 4 bytes

O tempo total para a leitura de uma palavra e a banda passante máxima será, respectivamente:

A

15 ns e 13,3 MB/s.

B

20 ns e 33,3 MB/s.

C

30 ns e 13,3 MB/s.

D

30 ns e 133 MB/s.

E

120 ns e 33,3 MB/s.

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Q51801

Ano: 2010 Banca: FCC Órgão: MPE-RN Prova: FCC - 2010 - MPE-RN - Analista de Tecnologia da Informação - Suporte Técnico |

Q51801 Arquitetura de Computadores

Em relação à memória cache, é correto afirmar que

A

se a CPU precisa de uma palavra e não a encontra na memória principal, ela busca na memória cache.

B

ela é utilizada para aumentar a capacidade de armazenamento da memória principal.

C

ela cuida do armazenamento de palavras de memória utilizadas com mais frequência pela CPU.

D

o princípio dos sistemas de cache é o da "anterioridade".

E

via de regra, instruções são mantidas na memória principal, e dados na memória cache.

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Q42262

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - BR Distribuidora - Analista de Sistemas Júnior - Infra-Estrutura |

Q42262 Arquitetura de Computadores

A denominação SMP refere-se tanto à arquitetura de hardware do computador quanto ao comportamento do sistema operacional que reflete esta arquitetura. Um SMP é um sistema de computador independente sobre o qual é INCORRETO afirmar que

A

existem dois ou mais processadores similares, com capacidade de computação compatível e que compartilham a mesma memória principal e facilidades de E/S.

B

o sistema é controlado por um sistema operacional integrado, que provê interação entre os processadores e seus programas, em nível de tarefas, de arquivos e de dados.

C

os processadores são conectados entre si por meio de um barramento ou de outro esquema de conexão interno, de forma que o tempo de acesso à memória é aproximadamente o mesmo para cada processador.

D

para resolver o problema de coerência de cache, utiliza um único cache para todos os processadores e adota a política de escrita direta onde as operações de escrita são usualmente efetuadas apenas sobre a cache, sendo a memória principal atualizada somente quando a linha correspondente é removida da cache.

E

como todos os processadores são capazes de desempenhar as mesmas funções, em um multiprocessador simétrico, uma falha em um único processador não causa a parada do sistema, podendo continuar a funcionar, com desempenho reduzido.

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Q42259

Ano: 2010 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2010 - BR Distribuidora - Analista de Sistemas Júnior - Infra-Estrutura |

Q42259 Arquitetura de Computadores

Um computador projetado com 512 endereços tem possibilidade de armazenar, na memória principal, 512 células (endereçadas desde a posição 0 até a posição 511). Sabendo-se, que para esse computador, cada célula é projetada para armazenar 10 bits (palavras de 10 bits), considere as afirmações a seguir.

I - Esse computador tem a capacidade de armazenar 5.120 kbits.
II - O registrador de dados da memória armazena 10 bits e a barra de dados também permite a passagem de 10 bits simultaneamente.
III - O registrador de endereço de memória e a barra de endereços armazenam, no mínimo, 9 bits para que seja possível o acesso a todas as posições de memória.

Está(ão) correta(s) a(s) afirmação(ões)

A

I, apenas.

B

II, apenas.

C

I e II, apenas.

D

II e III, apenas.

E

I, II e III.

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Q42054

Ano: 2010 Banca: FCC Órgão: DPE-SP Prova: FCC - 2010 - DPE-SP - Agente de Defensoria - Analista de Sistemas |

Q42054 Arquitetura de Computadores

Os relacionamentos entre as capacidades de armazenamento e os tempos de latência dos caches de memória são representados, respectivamente, pelas sequências

A

L1 < L2 < L3 e L1 = L2 = L3

B

L1 > L2 > L3 e L1 < L2 < L3

C

L1 < L2 < L3 e L1 > L2 > L3

D

L1 > L2 > L3 e L1 > L2 > L3

E

L1 < L2 < L3 e L1 < L2 < L3

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Q40871

Ano: 2010 Banca: ESAF Órgão: SUSEP Prova: ESAF - 2010 - SUSEP - Analista Técnico - Prova 2 - Tecnologia da Informação |

Q40871 Arquitetura de Computadores

Na alocação particionada dinâmica de memória

A

ocorre fragmentação externa.

B

ocorre fragmentação interna.

C

não ocorre fragmentação externa.

D

não ocorre nenhuma fragmentação.

E

utilizam-se partições de tamanho fixo.

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Q39729

Ano: 2010 Banca: FCC Órgão: TRF - 4ª REGIÃO Prova: FCC - 2010 - TRF - 4ª REGIÃO - Analista Judiciário - Tecnologia da Informação |

Q39729 Arquitetura de Computadores

Sobre o acesso direto à memória (Direct Memory Access ? DMA) é correto afirmar:

A

Um canal de acesso à memória (DMA) usa um controlador de entrada/saída para gerenciar transferências de dados entre dispositivos de entrada/saída e a memória principal.

B

Não é compatível com diversas arquiteturas de barramento.

C

Em arquiteturas legadas, como barramentos ISA, EISA ou MCA, um controlador de DMA não consegue gerenciar transferências entre a memória princi pal e dispositivos de entrada/saída

D

O DMA não melhora de forma significativa o desempenho em sistemas que executam grandes números de operações de entrada/saída (por exemplo, servi dores de grande porte).

E

Barramentos PCI empregam transferência por DMA de terceiros, o que requer um controlador para gerenciar o acesso ao barramento.

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Q36798

Ano: 2010 Banca: FCC Órgão: TRF - 4ª REGIÃO Prova: FCC - 2010 - TRF - 4ª REGIÃO - Técnico Judiciário - Informática |

Q36798 Arquitetura de Computadores

É um modelo de memória que trabalha com voltagem de 1,5 V e possui um buffer de 8 bits, elevando, dessa forma, seu pico de taxa de transferência a 6400 MB/s:

A

DDR2-800.

B

QDDR4-100QF.

C

DDR2-1066.

D

DDR3-800.

E

DDR3-1066.

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Q35405

Ano: 2010 Banca: FCC Órgão: TRE-AM Prova: FCC - 2010 - TRE-AM - Técnico Judiciário - Operação de Computador |

Q35405 Arquitetura de Computadores

Para instalação do OfficeScan Client 8.0 no Windows XP são requeridos, no mínimo, a memória RAM, o espaço em disco rígido e o Internet Explorer, respectivamente, de

A

256 MB, 350 MB e versão 6.0.

B

256 MB, 512 MB e versão 6.0.

C

512 MB, 512 MB e versão 6.0.

D

512 MB, 1 GB e versão 7.0.

E

1 GB, 1 GB e versão 7.0.

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Q34973

Ano: 2010 Banca: FCC Órgão: TRE-AM Prova: FCC - 2010 - TRE-AM - Programador de computador |

Q34973 Arquitetura de Computadores

Memórias DDR400, bastando configurá-las no CMOS Setup para a velocidade desejada, podem ser usadas para substituir a

A

DDR200, apenas.

B

DDR266, apenas.

C

DDR333, apenas.

D

DDR266 e a DDR333, apenas.

E

DDR200, a DDR226 e a DDR333.

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Q34935

Ano: 2010 Banca: FCC Órgão: TCM-PA Prova: FCC - 2010 - TCM-PA - Técnico em Informática |

Q34935 Arquitetura de Computadores

Se um processo que utiliza memória virtual por paginação tiver um número muito alto de falhas-de-páginas (page faults), provocando maior competição pelo espaço disponível da memória principal, será um problema denominado

A

swapping.

B

thrashing.

C

overhead.

D

overlay.

E

replacement.

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Q2262518

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: TRE-PR Prova: CESPE / CEBRASPE - 2009 - TRE-PR - Analista Judiciário - Analise de Sistemas |

Q2262518 Arquitetura de Computadores

Julgue o item seguinte acerca das memórias utilizadas pelos equipamentos computacionais.

O gerenciamento da memória cache tira proveito da concentração de referências, tendência que os programas têm em concentrar-se a cada intervalo de tempo em pequenas regiões dentro do espaço de endereçamento disponível.

Certo

Errado

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Q2262517

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: TRE-PR Prova: CESPE / CEBRASPE - 2009 - TRE-PR - Analista Judiciário - Analise de Sistemas |

Q2262517 Arquitetura de Computadores

Julgue o item seguinte acerca das memórias utilizadas pelos equipamentos computacionais.

Memória virtual é o resultado do processo de mapeamento de endereços não reais gerados pelo processador para endereços de memória física disponível.

Certo

Errado

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Q2252720

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: TRE-GO Prova: CESPE / CEBRASPE - 2009 - TRE-GO - Técnico Judiciário - Apoio Especializado - Operação de Computadores |

Q2252720 Arquitetura de Computadores

Considere a situação em que se deseje mais espaço em disco em um computador, mas não se queira remover software, nem reinstalar todo o sistema operacional. Considere que a solução seja configurar um HD extra no referido computador. Nessa situação, o HD a ser instalado no computador deverá ser configurado como

A

flat.

B

master

C

slave.

D

jumped.

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Questões de Concurso Comentadas sobre memória em arquitetura de computadores

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