Questões de Eletrônica - Eletrônica Digital para Concurso - Página 6

Q2573779

Ano: 2024 Banca: IV - UFG Órgão: IF-SE Prova: IV - UFG - 2024 - IF-SE - Professor EBTT - Eletrônica |

Q2573779 Eletrônica

Observe a figura a seguir.

Imagem associada para resolução da questão

Elaborado pelo(a) autor(a).

O tipo de porta lógica para o qual o circuito representado na figura acima pode ser simplificado é

A

porta E.

B

porta NÃO E.

C

porta NÃO OU.

D

porta OU EXCLUSIVO.

Incorreta. Gabarito oficial da banca:

Treine mais com um simulado focado no seu concurso. Criar simulado

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Q2573778

Ano: 2024 Banca: IV - UFG Órgão: IF-SE Prova: IV - UFG - 2024 - IF-SE - Professor EBTT - Eletrônica |

Q2573778 Eletrônica

Um determinado processo industrial é representado pela tabela verdade a seguir, composta por três entradas (A, B e C) e uma saída (Y).

Imagem associada para resolução da questão

Elaborado pelo(a) autor(a).

Qual a opção simplificada da expressão que realiza a tabela apresentada?

A

B

C

D

Incorreta. Gabarito oficial da banca:

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Q2523565

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Pleno I - Desenvolvimento de Instrumentação Científica para Projetos Espaciais |

Q2523565 Eletrônica

O circuito a seguir é composto por um buffer tri-state, um inversor com saída em coletor aberto e um resistor.

Imagem associada para resolução da questão

A combinação de sinais que gera conflito em S é

A

Imagem associada para resolução da questão

B

C

.

D

E

Incorreta. Gabarito oficial da banca:

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Q2516053

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516053 Eletrônica

Parte do código em VHDL a seguir deve ser completada para descrever um flip-flop JK a partir de um componente de um flip-flop D.
Imagem associada para resolução da questão

Assinale a opção que completa corretamente a linha assinalada.

A

SAIDA_D <= (J and (not ENT_D)) or (ENT_D and (not K)).

B

ENT_D <= (K and (not SAIDA_D)) or (SAIDA_D and (not J)).

C

SAIDA_D <= (K and (not ENT_D)) or (ENT_D and (not J)).

D

ENT_D <= (J and SAIDA_D) or ((not SAIDA_D) and (not K)).

E

ENT_D <= (J and (not SAIDA_D)) or (SAIDA_D and (not K)).

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Q2516050

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Desenvolvimento de Sistemas Eletrônicos Digitais |

Q2516050 Eletrônica

O diagrama em blocos de uma placa FPGA está mostrado na figura a seguir.
Imagem associada para resolução da questão

Fonte: kit SP601 - Xilinx

Como pode nele ser observado, o recurso que não está garantidamente presente na placa é que ela

A

seja configurada para ser um periférico serial do PC.

B

seja configurada por um computador via interface USB.

C

realize aquisições de dados analógicos de sensores.

D

seja configurada por outro tipo de interface além da USB.

E

use memórias tanto volátil quanto não volátil em projetos.

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Q2514407

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514407 Eletrônica

Um engenheiro encontrou o esquemático abaixo, indicativo de uma realimentação de um contador BCD crescente e decrescente, com LOAD síncrono e RIPPLE (RCO).
Imagem associada para resolução da questão

Assinale a opção que indica o número de estados da sequência permanente do contador.

A

6.

B

12.

C

5.

D

11.

E

8.

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Q2514406

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514406 Eletrônica

Dois flip-flops D devem implementar a sequência de estados Q_BQ_A do diagrama da figura a seguir.
Imagem associada para resolução da questão

A lógica de menor soma de produtos a ser usada para acionar D_B é

A

B

C

D

E

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Q2514405

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514405 Eletrônica

Após um pulso de CLR em nível baixo e mais de 30 pulsos de CLK, sem que ocorra novo pulso de CLR, o estado Q_BQ_A do circuito da figura acima, composto por dois flip-flops, dois inversores e mais uma porta lógica, ficará

A

alternando entre 01 e 10.

B

alternando entre 00 e 11.

C

estabilizado em 01.

D

estabilizado em 10.

E

alternando entre as 4 combinações possíveis de Q_BQ_A.

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Q2514404

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514404 Eletrônica

Assinale a opção que indica o produto d e somas que minimiza o mapa acima.

A

B

C

D

E

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Q2514403

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514403 Eletrônica

Sejam P, Q e R os números de 4 bits indicados no circuito da figura a seguir, em que se encontram um somador convencional de 4 bits, com entrada de um bit de transporte (Cin) e dois bancos de inversores INV1 e IVN2.
Imagem associada para resolução da questão

É correto afirmar que

A

R = P – Q.

B

R = Q – P – 1.

C

R = Q – P + 1.

D

R = P – Q – 1.

E

R = P – Q + 1.

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Q2514402

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514402 Eletrônica

As lógicas das saídas A<B e A=B do comparador unsigned do circuito acima são, respectivamente,

A

B

C

D

E

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Q2514372

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514372 Eletrônica

Em uma linguagem de pseudocódigo, na qual o sinal “<-“ significa atribuir valor, o sinal “<>” significa diferente, o sinal “=” significa comparação e o operador aritmético MOD significa resto da divisão, foi escrito o seguinte algoritmo:
Imagem associada para resolução da questão

Assinale a opção que indica os valores que serão impressos resultantes do Algoritmo “Teste”.

A

A = 3 A = 4 A = 5.

B

A = 2 A = 3.

C

A = 3 A = 4.

D

A = 2 A = 3 A = 4.

E

A = 2 A = 3 A = 5.

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Q2514371

Ano: 2024 Banca: FGV Órgão: INPE Prova: FGV - 2024 - INPE - Tecnologista Júnior I - Engenharia de Sistemas de Satélites - Arquitetura Elétrica |

Q2514371 Eletrônica

O circuito a seguir é composto por um buffer tri-state, um inversor com saída em coletor aberto e um resistor.
Imagem associada para resolução da questão

A combinação de sinais que gera conflito em S é

A

PQW.

B

C

D

E

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Q2478709

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478709 Eletrônica

No que se refere a circuitos lógicos, assinale a opção correta.

A

Decodificadores são dispositivos que convertem sinais digitais em sinais analógicos e têm aplicação no controle de motores em sistemas de automação.

B

Relógios são dispositivos utilizados para amplificar sinais de baixa potência e distribuí-los para vários componentes em um sistema.

C

EEPROM são memórias voláteis e perdem seus dados quando a energia é removida, ao passo que as memórias flash mantêm seus dados mesmo após a remoção da energia.

D

Multiplexador é um dispositivo que permite expandir a quantidade de memória disponível em um sistema embarcado.

E

Os registradores de deslocamento são frequentemente utilizados para converter sinais analógicos em digitais.

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Q2478706

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478706 Eletrônica

A respeito de conversores A/D e D/A utilizados em sistemas de áudio digital, assinale a opção correta.

A

Um conversor D/A com baixa taxa de amostragem pode fornecer uma reprodução de áudio de alta qualidade se a resolução de bits for alta.

B

Os conversores sigma-delta são os mais adequados para aplicações de áudio de alta fidelidade devido à sua alta taxa de amostragem.

C

Uma taxa de amostragem mais alta sempre resultará em uma melhor qualidade de áudio, independentemente dos demais componentes do sistema de áudio.

D

Quanto maior for a resolução de bits de um conversor D/A, melhor será a reprodução do áudio.

E

O fenômeno de aliasing ocorre apenas em conversores A/D quando a frequência do sinal analógico é menor que a metade da taxa de amostragem.

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Q2478705

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478705 Eletrônica

A respeito de circuitos lógicos, julgue os próximos itens.

I Contadores assíncronos são caracterizados por seus flip-flops funcionarem de maneira tal que não há entradas de clock em comum.
II Um flip-flop do tipo T é obtido a partir de um flip-flop JK com as entradas J e K curto-circuitadas.
III Em um registrador de deslocamento com flip-flops JK em série, as saídas de cada bloco são aplicadas nas entradas J e K respectivas do flip-flop seguinte.

Assinale a opção correta.

A

Apenas o item II está certo.

B

Apenas o item III está certo.

C

Apenas os itens I e II estão certos.

D

Apenas os itens I e III estão certos.

E

Todos os itens estão certos.

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Q2478703

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478703 Eletrônica

Acerca de contadores em circuitos lógicos, assinale a opção correta.

A

Em um contador assíncrono, cada flip-flop é atualizado de forma independente, ou seja, sem depender de um sinal de clock externo.

B

Um contador assíncrono é sincronizado por meio de um sinal de clock externo, ao passo que um contador síncrono não requer um sinal de clock.

C

Em um contador assíncrono, a contagem ocorre de forma síncrona em todos os flip-flops, o que garante precisão na contagem.

D

Contadores decimais são os mais comuns em circuitos lógicos devido à sua facilidade de implementação e utilização.

E

Em um contador binário, cada flip-flop representa um dígito binário, e a contagem ocorre quando os flip-flops são alternados.

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Q2478702

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478702 Eletrônica

Para que um sinaleiro luminoso acenda, todos os requisitos a seguir devem ser satisfeitos.

I Todos os quatro pressostatos (chave de pressão), P₁, P₂ , P₃ e P₄, devem estar fechados.
II Pelo menos duas das três chaves limites do circuito, S₁, S₂ e S₃, devem estar fechadas.
III A chave de reset, R, deve estar fechada.

A partir da situação apresentada e considerando que, se um elemento estiver fechado, sua saída será igual a 1, assinale a opção que corresponde à expressão lógica do circuito de controle do referido sinaleiro, assumindo que os símbolos +, x e ~ correspondem, respectivamente, às portas lógicas OR, AND e NOT.

A

B

C

D

E

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Q2478701

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478701 Eletrônica

Assinale a opção que corresponde à conversão do número 00011111 de base binária para base hexadecimal.

A

25

B

1F

C

4E

D

39

E

2F

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Q2478694

Ano: 2024 Banca: CESPE / CEBRASPE Órgão: LNA Prova: CESPE / CEBRASPE - 2024 - LNA - Tecnologista – Especialidade: Sistemas de Controle com Foco em Eletrônica, Automação e Programação de Instrumentação Científica |

Q2478694 Eletrônica

Em relação à eletrônica digital, assinale a opção correta.

A

Nos flip-flops tipo D, é possível utilizar os sinais adicionais clear (CLR) e preset (PRE) de forma complementar com o relógio, para evitar ações proibidas.

B

Nos latches SR, quando as entradas S e R têm estados lógicos iguais a 0, a ação executada pelo circuito sequencial é resetar.

C

No flip-flop D, construído por dois latches D disparados por um único clock, os latches são habilitados de forma independente, sendo o latch escravo habilitado quando o estado lógico do clock é igual a 1.

D

Um latch D construído a partir de um latch SR com habilitação E pode armazenar o valor binário na entrada sempre que E = 0.

E

O flip-flop toggle pode ser construído a partir de um flip-flop JK com os sinais de J e K em curto; nesse caso, o circuito inverte o sinal de saída do flip-flop no instante de cada transição do clock, tanto de 1 para 0 quanto de 0 para 1.

Incorreta. Gabarito oficial da banca:

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Questões de Concurso Sobre eletrônica digital em eletrônica

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