Questões Militares de Arquitetura de Computadores

Q4127560

Ano: 2026 Banca: MSConcursos Órgão: CBM-SC Prova: MSConcursos - 2026 - CBM-SC - Curso de Habilitação de Oficiais Especialistas |

Q4127560 Arquitetura de Computadores

Durante uma auditoria de TI, foi afirmado que “o desempenho de um Sistema Computacional depende, exclusivamente, da capacidade do hardware, sendo o software apenas um elemento acessório”.
Com base nos conceitos fundamentais de computação, assinale a alternativa verdadeira

A

Correta apenas em sistemas embarcados.

B

Incorreta apenas em sistemas distribuídos.

C

Correta, pois o hardware executa todas as operações computacionais.

D

Correta, pois softwares não interferem na eficiência do processamento.

E

Incorreta, pois software e hardware são interdependentes para execução de tarefas.

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Q3539445

Ano: 2025 Banca: VUNESP Órgão: TJM-SP Prova: VUNESP - 2025 - TJM-SP - Analista de Banco de Dados Judiciário |

Q3539445 Arquitetura de Computadores

Considere os dois números a seguir, de 32 bits, representados na forma binária.

01100110 11100111 10101010 11111111 b

00000000 11111111 00001111 00000001 b

Assinale a alternativa que apresenta o resultado, na forma binária, da soma desses dois números.

A

00100111 11111111 00001111 00000000 b

B

00000000 11100111 01010100 00000000 b

C

01100110 11111110 10100101 11111110 b

D

01100111 11100110 10111010 11111110 b

E

01100111 11100110 10111010 00000000 b

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Q3513313

Ano: 2025 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2025 - EsFCEx - Oficial - Especialidade: Informática |

Q3513313 Arquitetura de Computadores

No conjunto de instruções de um processador, diversos modos de endereçamento são encontrados e, dentre eles, existe o modo de endereçamento imediato, segundo o qual, na instrução de máquina, o

A

endereço efetivo do dado é o endereço presente no campo de endereço do operando.

B

endereço efetivo do dado está contido no registrador referenciado no campo de endereço.

C

operando (constante) é especificado diretamente no campo de endereço.

D

endereço efetivo do dado está contido em uma posição de memória cujo endereço é referenciado no campo do operando.

E

endereço efetivo do dado é o registrador referenciado no campo de endereço.

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Q3513312

Ano: 2025 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2025 - EsFCEx - Oficial - Especialidade: Informática |

Q3513312 Arquitetura de Computadores

Considere o circuito a seguir, com entradas A, B, C e D, e saída Z, composto por 3 portas lógicas do tipo XOR:

Q27.png (258×164)

Assinale a alternativa que apresenta, respectivamente, valores para as entradas A, B, C e D que resultem na saída Z=0.

A

0, 1, 0, 1

B

1, 0, 1, 1

C

1, 0, 0, 0

D

0, 0, 1, 0

E

1, 1, 1, 0

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Q3513309

Ano: 2025 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2025 - EsFCEx - Oficial - Especialidade: Informática |

Q3513309 Arquitetura de Computadores

Assinale a alternativa correta a respeito das memórias EPROM (Erasable Programmable Read-Only Memory) comumente utilizadas.

A

A memória EPROM é apagada por meio da exposição à luz infravermelha de alta intensidade.

B

Um exemplo de memória EPROM é a 27C512, que possui capacidade de armazenamento de 512 Kbytes

C

O processo de programação de uma memória EPROM é idêntico ao utilizado em memórias ROM convencionais.

D

Uma memória EPROM previamente apagada pode ser reprogramada em menos de um minuto, dependendo da sua capacidade e do programador de memória utilizado.

E

O tempo máximo necessário para apagar o conteúdo de uma EPROM típica é de aproximadamente um minuto.

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Q3485761

Ano: 2025 Banca: Marinha Órgão: Quadro Técnico Prova: Marinha - 2025 - Quadro Técnico - Primeiro-Tenente - Informática |

Q3485761 Arquitetura de Computadores

Segundo Tanenbaum (2013), grande parte das instruções tem operandos, sendo, portanto, necessário algum modo de especificar onde eles estão. O modo no qual o operando que está sendo especificado vem da memória ou vai para a memória, contudo seu endereço não está ligado à instrução, mas sim contido em um registrador, é denominado como endereçamento:

A

indireto de registrador.

B

direto.

C

de registrador.

D

indexado.

E

imediato.

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Q3485739

Ano: 2025 Banca: Marinha Órgão: Quadro Técnico Prova: Marinha - 2025 - Quadro Técnico - Primeiro-Tenente - Informática |

Q3485739 Arquitetura de Computadores

Segundo Tanenbaum (2013), duas das possibilidades existentes para o ganho de velocidade no chip são o:

A

paralelismo no nível da compilação e o aumento de memória cache.

B

multithreading no chip e o paralelismo no nível da instrução.

C

aumento de memória secundária e a duplicação da MMU (Memory Management Unity).

D

uso de processadores de 64 bits sem registradores e a ausência de memória cache.

E

uso de programas compilados em linguagem de alto nivel e de co-processadores.

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Q3485727

Ano: 2025 Banca: Marinha Órgão: Quadro Técnico Prova: Marinha - 2025 - Quadro Técnico - Primeiro-Tenente - Informática |

Q3485727 Arquitetura de Computadores

A conversão do número ‘DAD" representado em base hexadecimal para a base binária resulta em:

A

101110101101

B

110110101101

C

100110111111

D

101111001001

E

101110101100

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Q3485721

Ano: 2025 Banca: Marinha Órgão: Quadro Técnico Prova: Marinha - 2025 - Quadro Técnico - Primeiro-Tenente - Informática |

Q3485721 Arquitetura de Computadores

Sobre organização de computadores, analise as afirmativas abaixo.

I- Em uma CPU, o registrador Contador de Programa (PC - Program Counter) é a unidade responsável pela realização de operações lógicas e aritméticas.

lI- Requisições realizadas à memória principal consomem mais ciclos de CPU até sua resposta do que o acesso direto à memória cache do processador.

III- Memória virtual é uma característica de arquitetura cuja finalidade é permitir que programas usem espaço de endereço menor do que a memória física da máquina.

IV- Em um arranjo de discos RAID nível 3, um único bit de paridade é computado para cada palavra de dados e escrito em um drive de paridade.

Assinale a opção correta.

A

Apenas as afirmativas I e Il são verdadeiras.

B

Apenas as afirmativas II e ll são verdadeiras.

C

Apenas as afirmativas I e IIl são verdadeiras.

D

Apenas as afirmativas Il e IV são verdadeiras.

E

Apenas a afirmativa IV é verdadeira.

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Q3474601

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474601 Arquitetura de Computadores

O RAID (Redundant Array of Inexpensive Disks) é utilizado para tratar problemas de desempenho e confiabilidade. Qual RAID oferece a melhor redundância ao custo de mais espaço utilizado?

A

RAID 0.

B

RAID 1.

C

RAID 3.

D

RAID 5.

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Q3474593

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474593 Arquitetura de Computadores

Em relação à aritmética computacional é incorreto afirmar que:

A

A conversão de um número decimal para binário pode ser feita por meio de divisões sucessivas por 2, armazenando os restos

B

Em sistemas de ponto flutuante, a normalização garante que a mantissa sempre tenha um valor entre 0 e 1.

C

O underflow ocorre quando um número positivo muito pequeno se aproxima de zero e não pode ser representado corretamente.

D

O primeiro bit no padrão IEEE 754 é utilizado para representar o sinal do número (0 para positivo, 1 para negativo).

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Q3474592

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474592 Arquitetura de Computadores

Um computador paralelo, na qual todas as CPUs compartilham uma memória comum, é denominado um multiprocessador.
Quando cada CPU tem igual acesso a todos os módulos de memória e a todos dispositivos de E/S e é tratado pelo sistema operacional como intercambiável com as outras o sistema é denominado

A

multiprocessamento dinâmico.

B

arquitetura de cluster.

C

multiprocessamento distribuído.

D

multiprocessador simétrico.

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Q3474590

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474590 Arquitetura de Computadores

Considere as afirmativas a seguir sobre as arquiteturas de processadores CISC e RISC.

I. Um processador RISC exige um conjunto de circuitos mais complexos e um número maior de transistores.
II. Em diversas implementações RISC, não há instruções nativas para multiplicação e divisão, sendo essas operações executadas por meio de somas repetitivas e deslocamentos de bits (shifts).
III. Em arquiteturas RISC, as instruções possuem tamanhos variados para otimizar a eficiência do processador.
IV. Algumas instruções em arquitetura CISC podem acessar a memória diretamente, enquanto em RISC, o acesso à memória é realizado separadamente, por meio das instruções específicas de load e store.

Estão corretas apenas as afirmativas:

A

I e II.

B

II e III.

C

I e III.

D

II e IV.

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Q3474589

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474589 Arquitetura de Computadores

A hierarquia de memória tem a função de organizar os diferentes tipos de memória de acordo com sua velocidade, capacidade e custo. Relacione cada tipo de memória à sua respectiva finalidade:

Memória Finalidade

(1) Memória cache (2) Memória principal (3) Registradores (4) Memória secundária

Finalidade

( ) Armazena temporariamente dados com alta taxa de acesso pela CPU, reduzindo a latência de busca na memória RAM (Random Access Memory).
( ) Contém instruções e dados utilizados diretamente pelo processador para executar operações aritméticas e lógicas com máxima velocidade.
( ) Armazena dados e instruções em uso pelo processador, permitindo acesso rápido e eficiente durante a execução de programas.
( ) Oferece armazenamento permanente para grandes volumes de dados, com menor custo por unidade de armazenamento, mas com maior tempo de acesso.

A sequência correta dessa associação é:

A

(1); (3); (2); (4).

B

(1); (2); (3); (4).

C

(2); (3); (1); (4).

D

(4); (3); (2); (1).

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Q3474588

Ano: 2025 Banca: Aeronáutica Órgão: CIAAR Prova: Aeronáutica - 2025 - CIAAR - Engenharia da Computação |

Q3474588 Arquitetura de Computadores

Quando as referências à memória não encontram os dados nas caches L1 e L2 em uma CPU com paralelismo (pipeline), ocorre uma longa espera até que a palavra requisitada e sua linha de cache sejam carregadas. Nesse cenário, o pipeline é interrompido. Qual estratégia pode ser utilizada para mitigar esse problema?

A

Processadores multicore.

B

Clusterização.

C

Processamento em pipeline profundo.

D

Multithreading.

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Q3304020

Ano: 2025 Banca: UNEB Órgão: PM-BA Prova: UNEB - 2025 - PM-BA - Oficial da Policia Militar |

Q3304020 Arquitetura de Computadores

No contexto dos sistemas de computação, há um tipo de memória de alta velocidade integrada ao processador que tem como função armazenar temporariamente dados frequentemente acessados. Isso permite que o processador reduza o tempo de acesso a informações, aumentando significativamente o desempenho do sistema. Essa memória é conhecida como:

A

Cache.

B

Memória ROM.

C

Armazenamento em Nuvem.

D

Memória RAM.

E

Threads.

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Q3220507

Ano: 2025 Banca: SELECON Órgão: PM-SE Prova: SELECON - 2025 - PM-SE - Soldado PM - 3ª Classe - Combatente |

Q3220507 Arquitetura de Computadores

Um usuário de computador deseja adquirir um dispositivo de armazenamento de dados que funcione interno ao computador, que seja de rápido acesso, que não possua partes móveis, que tenha taxas de transferências altas e que se conecte diretamente à placa-mãe do computador por meio de barramento PCIe. Esse dispositivo é:

A

HDD IDE

B

HDD SATA

C

SSD NVMe

D

SSD SATA

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Q3264837

Ano: 2024 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2024 - EsFCEx - Oficial - Informática |

Q3264837 Arquitetura de Computadores

A respeito dos princípios de projeto de uma máquina RISC, assinale a alternativa que apresenta uma afirmação correta.

A

Todas as instruções de máquina podem referenciar posições de memória, exceto as instruções do tipo LOAD e STORE.

B

As instruções de máquina podem possuir tamanhos variados, com múltiplos campos, para aumentar suas potencialidades de uso.

C

A taxa de execução das instruções, medidas em MIPS – millions of instructions per second – deve ser minimizada, pois o mais importante é a potencialidade das instruções.

D

Todas as instruções devem ser executadas diretamente por hardware, sem serem interpretadas por microinstruções.

E

O número de registradores deve ser reduzido, pois, quanto menor o número e registradores, mais rapidamente as instruções são executadas.

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Q3264836

Ano: 2024 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2024 - EsFCEx - Oficial - Informática |

Q3264836 Arquitetura de Computadores

Dois números, A e B, estão expressos na notação binária.

A: 00111111
B: 00011111

Após a execução da operação de subtração A – B, o resultado em decimal é igual a:

A

16

B

48

C

32

D

24

E

64

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Q3264835

Ano: 2024 Banca: VUNESP Órgão: EsFCEx Prova: VUNESP - 2024 - EsFCEx - Oficial - Informática |

Q3264835 Arquitetura de Computadores

A expressão booleana X a seguir está expressa em função de A, B e C.
Captura_de tela 2025-03-27 171121.png (189×37)

Uma possível expressão booleana equivalente, obtida por meio do uso de operações presentes na álgebra booleana, é:

A

Captura_de tela 2025-03-27 171151.png (88×26)

B

ABC + A

C

Captura_de tela 2025-03-27 171159.png (37×22)

D

ABC

E

Captura_de tela 2025-03-27 171204.png (74×24)

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Questões Militares Sobre arquitetura de computadores

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