Questões de Arquitetura de Computadores para Concurso - Página 328

Q562559

Ano: 2012 Banca: OBJETIVA Órgão: EPTC Prova: OBJETIVA - 2012 - EPTC - Técnico de Informática com Ênfase em Suporte |

Q562559 Arquitetura de Computadores

A memória física de um computador é um recurso limitado, e muitas vezes a quantidade de memória necessária por um processo é maior que a quantidade de memória física disponível no computador. Nos sistemas operacionais modernos, o sistema operacional faz uso de um mecanismo que permite utilizar uma parte do disco rígido como memória auxiliar para contornar esse limite físico. Como é chamado tal mecanismo?

A

Memória auxiliar.

B

ROM.

C

Swapping.

D

Thread.

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Q562555

Ano: 2012 Banca: OBJETIVA Órgão: EPTC Prova: OBJETIVA - 2012 - EPTC - Técnico de Informática com Ênfase em Suporte |

Q562555 Arquitetura de Computadores

José deseja comprar um disco óptico para armazenar os arquivos dos projetos de arquitetura que constrói. Os arquivos do engenheiro ocupam um espaço de aproximadamente 2,1GB. Ele também deseja criar, modificar e excluir os arquivos desse disco. Qual das seguintes opções de disco óptico atende aos requisitos colocados por José?

A

CD-R.

B

CD-RW.

C

DVD-R.

D

DVD-RW.

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Q509308

Ano: 2012 Banca: IDECAN Órgão: Banestes Prova: IDECAN - 2012 - Banestes - Analista de Tecnologia da Informação - Suporte e Infraestrutura |

Q509308 Arquitetura de Computadores

As alternativas apresentam algumas características acerca do SMP. Assinale a alternativa INCORRETA sobre o SMP (Symmetric multiprocessor – multiplicador simétrico).

A

Esse modelo balanceia dinamicamente processos e memória, uma vez que existe apenas um conjunto de tabelas do sistema operacional.

B

A maioria dos processadores modernos utiliza essa organização.

C

O modelo SMP elimina o gargalo da CPU mestre, pois não existe nenhum mestre, mas introduz seus próprios problemas.

D

Cada região crítica é protegida por seu próprio mutex, de modo que somente uma CPU pode executá-la de cada vez.

E

Uma cópia do sistema operacional e suas tabelas está presente na CPU 1 e em nenhuma outra.

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Q492982

Ano: 2012 Banca: FUNIVERSA Órgão: CFM Prova: FUNIVERSA - 2012 - CFM - Assistente de Tecnologia da Informação |

Q492982 Arquitetura de Computadores

Considerando que todos os valores estão em hexadecimal, assinale a alternativa que apresenta uma operação correta na aritmética computacional.

A

(( 32 NOT ) OR BA ) = FD

B

(( 32 NOT ) AND BA ) = 44

C

(( 32 XOR CD ) AND AB) = AB

D

(( 32 XOR BA) AND DC ) = 77

E

(( 32 XOR DC) AND BA) = BA

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Q486909

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Infraestrutura Pleno |

Q486909 Arquitetura de Computadores

Considere os computadores pessoais (PC - Personal Computer) para responder à questão.

Algumas das características de um determinado componente de hardware de um PC são:

• armazenar informações durante o processamento.
• permitir a leitura, gravação e regravação de dados em seu interior.
• ser dependente de contínuo carregamento de energia elétrica.
• ter frequência medida em Hz (Hertz) ou MHz (Mega Hertz).

Qual componente possui tais características?

A

Porta USB

B

Memória RAM

C

Controladora SATA

D

Monitor

E

Fonte

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Q486908

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Infraestrutura Pleno |

Q486908 Arquitetura de Computadores

Considere os computadores pessoais (PC - Personal Computer) para responder à questão.

Entre os controladores de discos rígidos utilizados nos computadores, inclui-se o

A

AGP

B

TCP

C

HTML

D

SCSI

E

DIMM

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Q486889

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Infraestrutura Pleno |

Q486889 Arquitetura de Computadores

Processadores que dão suporte à memória virtual utilizam diversas técnicas de endereçamento no conjunto de instruções que disponibilizam. Em uma dessas técnicas, o valor do operando é especificado diretamente na instrução.
Essa forma de endereçamento é denominada endereçamento

A

direto

B

imediato

C

de registrador

D

por deslocamento

E

por valor

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Q486888

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Infraestrutura Pleno |

Q486888 Arquitetura de Computadores

A utilização de memória cache entre a UCP e a memória principal é algo bastante comum nos computadores atuais.
Essa utilização tem por objetivo

A

aumentar a capacidade global de memória de um computador

B

aumentar a taxa de transferência entre os dados residentes na UCP e os dispositivos de armazenamento secundário de alta velocidade, tais como discos magnéticos.

C

garantir a integridade dos dados, pois dessa forma é possível comparar os dados lidos da memória principal com os dados armazenados no cache.

D

obter uma velocidade de acesso à memória principal próxima à velocidade das memórias mais rápidas.

E

reduzir o custo de armazenamento, já que as memó- rias cache são bem mais baratas do que os módulos DRAM usados como memória principal.

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Q486640

Ano: 2012 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2012 - BR Distribuidora - Profissional Júnior - Formação Analista de Sistemas - Ênfase em Java - Crm e Web |

Q486640 Arquitetura de Computadores

Em um computador, o subsistema de memória é organizado hierarquicamente em uma pirâmide. Sobre o exposto, analise as afirmativas a seguir.

I - Os registradores, que possuem maior velocidade de transferência, menor capacidade de armazenamento e custo alto, estão no topo da pirâmide.
II - As memórias cache e a memória principal, que fornecem a garantia de armazenamento permanente ao usuário, estão no centro da pirâmide.
III - As memórias secundárias ou de massa, capazes de armazenar grandes quantidades de dados a um baixo custo, aparecem na base da pirâmide.

É correto o que se afirma em

A

I, apenas

B

II, apenas.

C

I e III, apenas

D

II e III, apenas

E

I, II e III.

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Q486635

Ano: 2012 Banca: CESGRANRIO Órgão: Petrobras Prova: CESGRANRIO - 2012 - BR Distribuidora - Profissional Júnior - Formação Analista de Sistemas - Ênfase em Java - Crm e Web |

Q486635 Arquitetura de Computadores

Processadores RISC implementam instruções complexas, porém paralelizáveis, que levam, aproximadamente, a mesma quantidade de tempo para serem executadas pelos processadores.
PORQUE
Arquiteturas RISC têm como princípio otimizar o desempenho de uma máquina reduzindo o número de ciclos por instrução, mesmo que isso acarrete um maior número de instruções por programa.
Analisando-se as afirmações acima, conclui-se que

A

as duas afirmações são verdadeiras, e a segunda justifica a primeira.

B

as duas afirmações são verdadeiras, e a segunda não justifica a primeira.

C

a primeira afirmação é verdadeira, e a segunda é falsa.

D

a primeira afirmação é falsa, e a segunda é verdadeira.

E

as duas afirmações são falsas.

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Q486108

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Sistemas Júnior - Ênfase em Negócio |

Q486108 Arquitetura de Computadores

Processadores do tipo CISC são mais usados nos consoles de videogames mais modernos.

PORQUE

Processadores do tipo CISC geralmente têm um conjunto de instruções maior que processadores do tipo RISC.

Analisando-se as afirmações acima, conclui-se que:

A

as duas afirmações são verdadeiras, e a segunda justifica a primeira

B

as duas afirmações são verdadeiras, e a segunda não justifica a primeira

C

a primeira afirmação é verdadeira, e a segunda é falsa.

D

a primeira afirmação é falsa, e a segunda é verdadeira.

E

as duas afirmações são falsas.

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Q486103

Ano: 2012 Banca: CESGRANRIO Órgão: PETROQUÍMICA SUAPE Prova: CESGRANRIO - 2012 - PETROQUÍMICA SUAPE - Analista de Sistemas Júnior - Ênfase em Negócio |

Q486103 Arquitetura de Computadores

Considere as afirmações a seguir referentes a memórias cache de sistemas computacionais.

I - O projeto de uma memória cache pode prever sua implementação de forma unificada ou separada.

II - Em caches L2, os acessos são realizados mais rapidamente que os ciclos de barramento, com estado zero-wait (tempo de espera nulo).

III - Algoritmos de substituição de quadros são indispensáveis à eleição do bloco a ser retirado de uma cache cheia.

IV - Na técnica de mapeamento associativo, um bloco da memória principal pode ser alocado em qualquer linha da cache.

São corretas APENAS as afirmações

A

I e II

B

I e IV

C

III e IV

D

I, II e III

E

II, III e IV

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Q485464

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGAS - Profissional Júnior - Análise de Infraestrutura |

Q485464 Arquitetura de Computadores

Sistemas MIMD (Multiple Instruction Multiple Data) podem ser subdivididos de acordo com a forma de comunicação entre os processadores e o grau de compartilhamento da memória.
No SMP (Symetric Multiprocessors), em um sistema fortemente acoplado, constata-se que

A

cada processador utiliza uma única memória ou um conjunto de memórias por meio de um barramento compartilhado no mesmo hardware, e que o tempo de acesso a qualquer região da memória é aproximadamente o mesmo para cada processador.

B

cada processador utiliza uma única memória ou um conjunto de memórias por meio de um barramento compartilhado no mesmo hardware, mas que o tempo de acesso a diferentes regiões da memória é diferente para cada processador.

C

vários processadores compartilham uma única memória ou um conjunto de memórias por meio de um barramento compartilhado no mesmo hardware, e que o tempo de acesso a qualquer região da memória é aproximadamente o mesmo para cada processador.

D

vários processadores compartilham uma única memória ou um conjunto de memórias por meio de um barramento compartilhado no mesmo hardware, mas que o tempo de acesso a diferentes regiões da memória é diferente para cada processador.

E

vários sistemas de computação compartilham dados de suas memórias por meio de uma rede de comunicação de dados externa ao hardware, e que o tempo de acesso a qualquer região da memória, em cada sistema de computação, pode ou não ser o mesmo para cada processador.

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Q485457

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGAS - Profissional Júnior - Análise de Infraestrutura |

Q485457 Arquitetura de Computadores

Os processadores utilizam diferentes técnicas para acelerar a execução de instruções. Uma dessas técnicas envolve a divisão do ciclo de instruções em um determinado número de estágios consecutivos, possibilitando que cada estágio trabalhe simultaneamente em uma instrução diferente.

Essa técnica chama-se

A

cachê

B

stacking

C

pipelining

D

turbo boost

E

hyper-threading

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Q482781

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGÁS - Profissional Júnior - Administração de Banco de Dados |

Q482781 Arquitetura de Computadores

Uma questão importante quanto ao gerenciamento da memória principal de um computador é o gerenciamento do espaço de endereços dos processos.
Considerando que cada posição endereçável da memória consiste em 1 byte, um endereço de memória de 32 bits permite endereçar uma memória de

A

4294967 bytes

B

3200 Kbytes

C

512 Mbytes

D

4 Gbytes

E

1 Tbyte

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Q482775

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGÁS - Profissional Júnior - Administração de Banco de Dados |

Q482775 Arquitetura de Computadores

Uma organização que utiliza um barramento de serviços corporativos deve utilizar como infraestrutura uma arquitetura orientada a serviços.

PORQUE

O propósito de um barramento de serviços corporativos é fornecer interoperabilidade juntamente com serviços adicionais, tais como segurança e monitoramento.

Analisando-se as afirmações acima, conclui-se que

A

as duas afirmações são verdadeiras, e a segunda justifica a primeira.

B

as duas afirmações são verdadeiras, e a segunda não justifica a primeira.

C

a primeira afirmação é verdadeira, e a segunda é falsa.

D

a primeira afirmação é falsa, e a segunda é verdadeira.

E

as duas afirmações são falsas.

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Q481233

Ano: 2012 Banca: CESGRANRIO Órgão: Caixa Prova: CESGRANRIO - 2012 - Caixa - Técnico Bancário - Tecnologia da Informação |

Q481233 Arquitetura de Computadores

Qual é a taxa máxima de transferência, em MB/s, da interface de barramento SATA (Advanced Technology Attachment) 2.0?

A

60

B

100

C

300

D

600

E

1000

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Q481231

Ano: 2012 Banca: CESGRANRIO Órgão: Caixa Prova: CESGRANRIO - 2012 - Caixa - Técnico Bancário - Tecnologia da Informação |

Q481231 Arquitetura de Computadores

Dentre as técnicas de endereçamento usadas pelas unidades centrais de processamento (CPU) encontradas no mercado, NÃO se inclui a de endereçamento

A

à memória virtual

B

à pilha

C

direto

D

imediato

E

de registrador

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Q476287

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGAS - Profissional Júnior - Desenvolvimento de Aplicações |

Q476287 Arquitetura de Computadores

Um processador hipotético tem dois registradores de uso geral X e Y, ambos de 8 bits. As instruções desse processador têm um formato de tamanho fixo de 32 bits, dos quais os 8 mais significativos, ou seja, os primeiros lidos da memória durante a busca, são utilizados para o OpCode e os 24 restantes para operandos. Uma das operações desse processador, cujo OpCode é igual a 10110100, utiliza dois operandos: o primeiro é imediato de 8 bits e o segundo utiliza os 16 bits restantes para um endereçamento direto. O resultado da execução dessa operação é colocar a soma dos dois operandos no registrador X. Os operandos são inteiros de 8 bits e utiliza-se o complemento a 2.

Considere que a próxima instrução a ser executada está no endereço 00A1. O conteúdo da memória, nesse instante, está ilustrado na Figura. Como resultado da operação, o registrador X conterá o valor, em base decimal, de

A

264

B

255

C

- 264

D

- 37

E

7

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Q476278

Ano: 2012 Banca: CESGRANRIO Órgão: LIQUIGÁS Prova: CESGRANRIO - 2012 - LIQUIGAS - Profissional Júnior - Desenvolvimento de Aplicações |

Q476278 Arquitetura de Computadores

Há diversas formas pelas quais um sistema computacional pode tratar os eventos de entrada e saída (E/S). O esquema no qual a Unidade Central de Processamento (UCP) fica ocupada em um laço de repetição (loop) à espera do término de uma operação de E/S é conhecido como esquema de

A

Interrupção

B

Prioridades

C

E/S programada

D

E/S mapeada em memória

E

DMA

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Questões de Concurso Sobre arquitetura de computadores

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