Questões de Arquitetura de Computadores - Memória para Concurso - Página 50

Q1202602

Ano: 2009 Banca: IESES Órgão: TJ-MA

Q1202602 Arquitetura de Computadores

Analise as seguintes questões relacionadas as memórias:
I. As memórias EEPROMs são voláteis oferecem tempos de acesso reduzidos e têm alta densidade e baixo custo por bit. Entretanto, elas podem ser apagadas em bloco por luz UV.
II. A célula de memória flash é semelhante à célula com único transistor da EPROM (diferente da célula mais complexa da EEPROM com dois transistores), apenas um pouco maior. Elas podem ser apagadas eletricamente no circuito, por setor ou em bloco (todas as células).
III. As memórias programáveis MROMs tipicamente costumam ter saídas tristate que permitem que sejam usadas em um sistema de barramento. A exemplo das PROMs essas memórias não podem ser apagadas ou reprogramadas.
IV. As memórias EPROMs são não-voláteis, oferecem rápido acesso para leitura e permitem que o apagamento e a reprogramação de bytes individuais sejam feitos de maneira rápida no circuito.
A seqüência CORRETA é:

A

Apenas as assertivas II e III estão corretas

B

As assertivas I, II, III e IV estão corretas.

C

Apenas as assertivas I, III e IV estão correta.

D

As assertivas II e IV estão corretas.

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Q129446

Ano: 2009 Banca: NCE-UFRJ Órgão: UFRJ Prova: NCE-UFRJ - 2009 - UFRJ - Técnico - Tecnologia da Informação |

Q129446 Arquitetura de Computadores

Pequena quantidade de memória estática de alto desempenho, normalmente integrada aos processadores, tem por finalidade aumentar a velocidade de processamento. Esta definição se refere à seguinte memória:

A

Virtual;

B

Cache;

C

ROM;

D

Principal;

E

Secundária.

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Q123549

Ano: 2009 Banca: FCC Órgão: TCE-GO Prova: FCC - 2009 - TCE-GO - Técnico de Controle Externo - Tecnologia da Informação |

Q123549 Arquitetura de Computadores

É o tipo de processamento paralelo em que computadores com mais de um processador com as mesmas características compartilham o mesmo barramento e a mesma memória:

A

MLR (Mutiprocessing Local Resources).

B

PVM (Parallel Virtual Machine).

C

MPI (Message Passing Interface).

D

LAM (Local Area Multicomputer).

E

SMP (Symetric Multi Processor).

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Q95831

Ano: 2009 Banca: INSTITUTO CIDADES Órgão: UNIFESP Prova: INSTITUTO CIDADES - 2009 - UNIFESP - Analista de Tecnologia da Informação |

Q95831 Arquitetura de Computadores

Acerca de memória cache, marque a alternativa CORRETA:

A

Esta memória fica localizada entre a memória flash e a CPU.

B

Quanto maior o tamanho da memória cache, menor o número de portas envolvidas no endereçamento. Consequentemente, memória cache grande tende a ser mais rápida do que as pequenas.

C

É na memória cache onde o sistema operacional é carregado.

D

No que diz respeito à memória cache, os algoritmos de substituição são: LRU, FIFO, LFU e Random.

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Q95830

Ano: 2009 Banca: INSTITUTO CIDADES Órgão: UNIFESP Prova: INSTITUTO CIDADES - 2009 - UNIFESP - Analista de Tecnologia da Informação |

Q95830 Arquitetura de Computadores

Marque a alternativa CORRETA acerca de Memória RAM Dinâmica:

A

Os bits são armazenados em capacitores.

B

Não necessita de recurso de refresh.

C

Seu preço de mercado costuma ser mais caro que o da memória estática.

D

Possui um tamanho de célula maior que o da memória RAM estática.

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Q95827

Ano: 2009 Banca: INSTITUTO CIDADES Órgão: UNIFESP Prova: INSTITUTO CIDADES - 2009 - UNIFESP - Analista de Tecnologia da Informação |

Q95827 Arquitetura de Computadores

Acerca de método de acesso de memória de um computador moderno, assinale a alternativa INCORRETA.

A

No método de acesso aleatório, cada posição endereçável possui um mecanismo de endereçamento único e fisicamente conectado a ele.

B

No método de acesso associativo, uma palavra é buscada com base em uma parte de seu conteúdo e não de acordo com o seu endereço.

C

O método de acesso aleatório é um tipo de memória aleatória que compara simultaneamente certo número de bits de uma palavra com todas as palavras da memória, determinando as que possuem o mesmo padrão de bits.

D

No método de acesso aleatório, o tempo de acesso não depende da localização ou do acesso anterior.

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Q76614

Ano: 2009 Banca: UFF Órgão: UFF Prova: UFF - 2009 - UFF - Técnico de Laboratório - Informática |

Q76614 Arquitetura de Computadores

O processo de alternar dados entre a memória virtual e a memória RAM, conforme a necessidade de uso, é conhecido como:

A

Swapping;

B

FIFO;

C

Alocação Contínua;

D

Cache;

E

Fragmentação.

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Q74640

Ano: 2009 Banca: UFF Órgão: UFF Prova: UFF - 2009 - UFF - Analista de Tecnologia da Informação |

Q74640 Arquitetura de Computadores

Em relação ao hardware, o tipo de memória estática que, apesar de ser mais rápida que a dinâmica, tem capacidade menor de armazenamento de dados, sendo utilizada em chips de memória cache, é conhecido como:

A

PROM;

B

DRAM;

C

EPROM;

D

SRAM;

E

EAROM.

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Q59640

Ano: 2009 Banca: VUNESP Órgão: CETESB Prova: VUNESP - 2009 - CETESB - Analista de redes e comunicação de dados |

Q59640 Arquitetura de Computadores

A memória cache possibilita diminuir o tempo de acesso do processador à memória, com o uso de uma memória mais rápida (cache) entre o processador e a memória principal (mais lenta). Quando o processador fornece um endereço de uma posição de memória a ser acessada e cujo conteúdo não se encontra armazenado na memória cache, diz-se que ocorreu um

A

cache hit.

B

cache miss.

C

write back.

D

write through.

E

write deferred.

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Q58376

Ano: 2009 Banca: VUNESP Órgão: CETESB Prova: VUNESP - 2009 - CETESB - Analista de TI - Analista de Suporte |

Q58376 Arquitetura de Computadores

Considere as seguintes afirmações relacionadas com a memória flash:

I. permite que os conteúdos de múltiplos endereços sejam apagados ou escritos em uma só operação;

II. é um tipo de memória não volátil e, por isso, precisa de energia para manter as informações nela armazenadas;

III. apresenta um tempo de acesso maior que o da memória DRAM, utilizada como memória principal em PCs.

Sobre as afirmações, pode-se dizer que está correto o contido em

A

I, apenas.

B

I e II, apenas.

C

I e III, apenas.

D

II e III, apenas.

E

I, II e III.

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Q50062

Ano: 2009 Banca: FCC Órgão: TJ-PA Prova: FCC - 2009 - TJ-PA - Analista Judiciário - Análise de Sistema (Suporte) |

Q50062 Arquitetura de Computadores

Considere as afirmativas sobre memória RAM.

I. DIMM contém chips DRAM apenas e SIMM contém chips DRAM ou SRAM.

II. DIMM é uma placa que contém chips DRAM em ambos os lados.

III. SIMM é uma placa que contém chips DRAM em apenas um lado.

É correto o que se afirma em

A

I, apenas.

B

I e II, apenas.

C

I e III, apenas.

D

II e III, apenas.

E

I, II e III.

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Q50057

Ano: 2009 Banca: FCC Órgão: TJ-PA Prova: FCC - 2009 - TJ-PA - Analista Judiciário - Análise de Sistema (Suporte) |

Q50057 Arquitetura de Computadores

Ao ligar um computador são executadas as etapas abaixo.

I. Contar a quantidade de memória disponível.

II. Verificar se a memória está funcionando corretamente.

III. Identificar os dispositivos conectados ao computador.

IV. Localizar o sistema operacional.

A sequência de execução correta é apresentada em

A

I, III, II e IV.

B

II, III, I e IV.

C

II, IV, III e I.

D

III, I, II e IV.

E

IV, III, II e I.

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Q49914

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: ANAC Prova: CESPE - 2009 - ANAC - Técnico Administrativo - Informática |

Q49914 Arquitetura de Computadores

Texto associado

Considerando que a arquitetura de computadores trata do
comportamento funcional de um sistema computacional, julgue
os itens subsequentes.

A memória ROM é usada para manter os programas, o sistema operacional e os dados exigidos pelo computador.

Certo

Errado

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Q49906

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: ANAC Prova: CESPE - 2009 - ANAC - Técnico Administrativo - Informática |

Q49906 Arquitetura de Computadores

Texto associado

A respeito de fundamentos de computação, julgue os itens
seguintes.

A memória é a parte ativa da placa-mãe diretamente responsável pela execução das instruções de um programa.

Certo

Errado

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Q49778

Ano: 2009 Banca: FCC Órgão: TJ-SE Prova: FCC - 2009 - TJ-SE - Programador de computador |

Q49778 Arquitetura de Computadores

A quantidade de posições de memória que um barramento de endereços de 32 bits pode acessar, em bytes, é de no máximo

A

1024 × 1024 × 1024 × 1024.

B

1024 × 1024 × 1024 × 4.

C

1024 × 1024 × 1024 × 2.

D

1024 × 1024 × 1024.

E

1024 × 1024 × 4.

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Q25518

Ano: 2009 Banca: FCC Órgão: TJ-PI Prova: FCC - 2009 - TJ-PI - Técnico Judiciário - Informática |

Q25518 Arquitetura de Computadores

Em relação à arquitetura de memórias, analise:

I. A utilização da arquitetura dual-channel, presente em alguns tipos de memória, depende, também, dela existir no chipset da placa-mãe.

II. Dual-channel é uma tecnologia implementada exclusivamente em pentes de memória e sua dependência à placa-mãe reside apenas na quantidade de slots disponíveis na placa-mãe.

III. A tecnologia dual-channel só funciona quando os pentes de memória são instalados aos pares, ou seja, devem existir pelo menos dois slots de memória na placa-mãe.

IV. Memórias DDR não contam com a tecnologia dual- channel, pois sua primeira implementação passou a ocorrer a partir das memórias DDR2.

É correto o que consta APENAS em

A

I, III e IV.

B

II e IV.

C

I e III.

D

II, III e IV.

E

III e IV.

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Q25517

Ano: 2009 Banca: FCC Órgão: TJ-PI Prova: FCC - 2009 - TJ-PI - Técnico Judiciário - Informática |

Q25517 Arquitetura de Computadores

O técnico que diagnosticou o problema nos pentes de memória do microcomputador encontra-se ausente e, com ele, os pentes com problema. Na avaliação visual dos slots existentes na placa-mãe, outro profissional constatou que o pente de memória adequado àquele slot é o pente de 168 terminais. Dessa forma, trata-se da memória com tecnologia

A

DIMM.

B

DDR.

C

DDR1.

D

DDR2.

E

DDR3.

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Q23924

Ano: 2009 Banca: FCC Órgão: TRT - 3ª Região (MG) Prova: FCC - 2009 - TRT - 3ª Região (MG) - Técnico Judiciário - Tecnologia da Informação |

Q23924 Arquitetura de Computadores

O termo mapeamento é usado para indicar o relacionamento dos dados do nível inferior com as posições da memória cache. O mapeamento de memória cache, no qual a posição na cache depende do endereço da palavra e cada palavra possui uma posição fixa na cache, é denominado

A

direto.

B

associativo.

C

conjuntivo.

D

relativo.

E

fixo.

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Q18882

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: ANAC Prova: CESPE - 2009 - ANAC - Analista Administrativo - Tecnologia da Informação |

Q18882 Arquitetura de Computadores

Texto associado

Quanto aos conceitos de hardware e software, julgue os itens de
36 a 40.

Em um computador com 64K células de memória, instruções de um operando, e um conjunto de 256 instruções de máquina, em que cada instrução tenha o tamanho de uma célula, que é o mesmo tamanho da palavra do sistema, as instruções que trabalham com o modo de endereçamento direto nessa máquina devem ter 16 bits de tamanho.

Certo

Errado

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Q18881

Ano: 2009 Banca: CESPE / CEBRASPE Órgão: ANAC Prova: CESPE - 2009 - ANAC - Analista Administrativo - Tecnologia da Informação |

Q18881 Arquitetura de Computadores

Texto associado

Quanto aos conceitos de hardware e software, julgue os itens de
36 a 40.

O barramento AGP foi desenvolvido com o propósito de acelerar as transferências de dados do vídeo para a memória. Trata-se, pois, de uma interface que permite a comunicação direta do adaptador de vídeo com a memória RAM.

Certo

Errado

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Questões de Concurso Comentadas sobre memória em arquitetura de computadores

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