Questões de Concurso Sobre engenharia eletrônica
Foram encontradas 4.428 questões
Ano: 2014
Banca:
CESGRANRIO
Órgão:
Petrobras
Prova:
CESGRANRIO - 2014 - Petrobras - Técnico(a) de Manutenção Júnior - Eletrônica |
Q454003
Engenharia Eletrônica
Foundation Fieldbus (FF) é uma arquitetura aberta para integrar informação, que tem como objetivo principal interconectar equipamentos de controle e automação industrial, distribuindo as funções de controle pela rede e fornecendo informação a todas as camadas do sistema.
As camadas físicas nessa arquitetura estão distribuídas em duas redes; uma de baixa velocidade (31,25 Kbits/s) e outra de alta velocidade (100 Mbps), designadas, respectivamente, como
As camadas físicas nessa arquitetura estão distribuídas em duas redes; uma de baixa velocidade (31,25 Kbits/s) e outra de alta velocidade (100 Mbps), designadas, respectivamente, como
Ano: 2014
Banca:
CESGRANRIO
Órgão:
Petrobras
Prova:
CESGRANRIO - 2014 - Petrobras - Técnico(a) de Manutenção Júnior - Eletrônica |
Q454000
Engenharia Eletrônica
A Figura abaixo mostra uma aplicação típica do protocolo HART em uma rede ponto a ponto, onde um PC obtém informações de uma válvula de controle.
O Protocolo HART possibilita a comunicação digital bidirecional em instrumentos de campo inteligentes, sem interferir no sinal analógico de 4-20 mA. Usando-se o padrão Bell 202, de chaveamento por deslocamentos de frequência (FSK), para sobrepor os sinais de comunicação digital ao de 4-20 mA, e por ser o sinal digital FSK simétrico em relação ao zero, no Protocolo HART, observa-se que a lógica “1” e a lógica “0”, respectivamente, são representadas, em Hz, por frequências de
O Protocolo HART possibilita a comunicação digital bidirecional em instrumentos de campo inteligentes, sem interferir no sinal analógico de 4-20 mA. Usando-se o padrão Bell 202, de chaveamento por deslocamentos de frequência (FSK), para sobrepor os sinais de comunicação digital ao de 4-20 mA, e por ser o sinal digital FSK simétrico em relação ao zero, no Protocolo HART, observa-se que a lógica “1” e a lógica “0”, respectivamente, são representadas, em Hz, por frequências de
Ano: 2014
Banca:
CESGRANRIO
Órgão:
Petrobras
Prova:
CESGRANRIO - 2014 - Petrobras - Técnico(a) de Manutenção Júnior - Eletrônica |
Q453995
Engenharia Eletrônica
Em um sistema de controle de processos, os transmissores são equipamentos destinados a medir a variável do processo e a transmitir a informação para outros equipamentos receptores. Os sinais transmitidos podem apresentar características elétricas, hidráulicas, pneumáticas ou eletrônicas. Os sinais eletrônicos são padrões conhecidos como 4 a 20 mA, 10 a 50 mA e 1 a 5 V, dependendo do fabricante do equipamento.
Ao longo do tempo, a comunicação evoluiu do padrão analógico 4 a 20 mA para uma comunicação com padrão digital. O primeiro passo nesse sentido foi a utilização do protocolo HART (Highway Addressable Remote Transducer), um protocolo mestre escravo com taxa de transmissão de 1200 BPS, usando modulação FSK (Frequency Shift Keying), que é sobreposto ao sinal 4 a 20 mA.
Nesse contexto, em relação ao protocolo HART, observa-se que
Ao longo do tempo, a comunicação evoluiu do padrão analógico 4 a 20 mA para uma comunicação com padrão digital. O primeiro passo nesse sentido foi a utilização do protocolo HART (Highway Addressable Remote Transducer), um protocolo mestre escravo com taxa de transmissão de 1200 BPS, usando modulação FSK (Frequency Shift Keying), que é sobreposto ao sinal 4 a 20 mA.
Nesse contexto, em relação ao protocolo HART, observa-se que
Ano: 2014
Banca:
FGV
Órgão:
TJ-GO
Prova:
FGV - 2014 - TJ-GO - Analista Judiciário - Engenheiro Eletricista |
Q445955
Engenharia Eletrônica
Texto associado
Considere o circuito digital abaixo:
A sequência de entradas A, B, C, D e E que determina uma saída igual a um é:
Ano: 2014
Banca:
FGV
Órgão:
TJ-GO
Prova:
FGV - 2014 - TJ-GO - Analista Judiciário - Engenheiro Eletricista |
Q445954
Engenharia Eletrônica
As memórias são compostas por células e cada uma das células pode armazenar parte de uma informação. Os programas referenciam essas células por meio de endereçamento. Com o número de bits utilizado para o endereçamento das células igual a 4, a quantidade máxima de células que pode ser acessada é:
Ano: 2014
Banca:
FGV
Órgão:
TJ-GO
Prova:
FGV - 2014 - TJ-GO - Analista Judiciário - Engenheiro Eletricista |
Q445948
Engenharia Eletrônica
Texto associado
O esquema eletrônico a seguir apresenta um dispositivo de disparo utilizando SCR.
Na condição em que o SCR está conduzindo, a potência dissipada no resistor de 100 Ω que está ligado ao anodo é 25 W e a corrente de gatilho é 450 mA. A tensão de gatilho do SCR para essas condições é igual a:
Ano: 2014
Banca:
CESGRANRIO
Órgão:
LIQUIGÁS
Prova:
CESGRANRIO - 2014 - LIQUIGÁS - Engenheiro Júnior - Elétrica |
Q438737
Engenharia Eletrônica
Motivado pela Copa do Mundo de 2014, um torcedor decidiu montar um letreiro luminoso com as três primeiras letras do nome de nosso país: BRA. Nesse letreiro, o acendimento de cada letra é comandado pelo circuito digital sequencial ilustrado a seguir.
Esse circuito foi projetado de modo que uma determinada letra acenderá somente quando o seu respectivo sinal de comando digital assumir um nível lógico alto.
O objetivo desse circuito é fazer com que as letras acendam e apaguem, repetindo a ordem mostrada pelo diagrama apresentado. Nessa sequência, as três começam apagadas, e, depois, as letras vão acendendo uma a uma até que todas estejam acesas ao final da sequência.
Para realizar a sequência de acendimento desejada, o circuito combinacional deve produzir os sinais de comando dos flip-flops tipo D, através do seguinte par de funções lógicas:
Esse circuito foi projetado de modo que uma determinada letra acenderá somente quando o seu respectivo sinal de comando digital assumir um nível lógico alto.
O objetivo desse circuito é fazer com que as letras acendam e apaguem, repetindo a ordem mostrada pelo diagrama apresentado. Nessa sequência, as três começam apagadas, e, depois, as letras vão acendendo uma a uma até que todas estejam acesas ao final da sequência.
Para realizar a sequência de acendimento desejada, o circuito combinacional deve produzir os sinais de comando dos flip-flops tipo D, através do seguinte par de funções lógicas:
Ano: 2014
Banca:
CESGRANRIO
Órgão:
LIQUIGÁS
Prova:
CESGRANRIO - 2014 - LIQUIGÁS - Engenheiro Júnior - Elétrica |
Q438736
Engenharia Eletrônica
No tanque de gás representado na Figura a baixo, a válvula de entrada W e as válvulas de saída X, Y e Z são comandadas digitalmente. Nesse comando digital, um sinal de nível lógico alto produz a abertura da válvula, e um sinal de nível baixo leva ao fechamento da mesma. Além disso, o sistema possui um sensor de pressão digital P de apenas um bit, onde P = 0 indica que a pressão no interior do tanque está abaixo do mínimo desejado.
Nesse sistema, a válvula W deve ser aberta para permitir a entrada de gás, sempre que duas ou mais válvulas de saída estiverem abertas, ou quando a pressão no interior do tanque estiver abaixo do mínimo desejado.
Qual é o circuito digital que deve ser usado para produzir o sinal de comando da válvula W?
Nesse sistema, a válvula W deve ser aberta para permitir a entrada de gás, sempre que duas ou mais válvulas de saída estiverem abertas, ou quando a pressão no interior do tanque estiver abaixo do mínimo desejado.
Qual é o circuito digital que deve ser usado para produzir o sinal de comando da válvula W?
Ano: 2014
Banca:
CESGRANRIO
Órgão:
LIQUIGÁS
Prova:
CESGRANRIO - 2014 - LIQUIGÁS - Engenheiro Júnior - Elétrica |
Q438735
Engenharia Eletrônica
A Figura a seguir apresenta um circuito, no qual o diodo D1 é ideal, e o gráfico da evolução no tempo da tensão entregue pela fonte VS desse circuito.
Qual é a correspondente forma de onda da corrente iD no diodo?
Qual é a correspondente forma de onda da corrente iD no diodo?
Ano: 2014
Banca:
CESGRANRIO
Órgão:
LIQUIGÁS
Prova:
CESGRANRIO - 2014 - LIQUIGÁS - Engenheiro Júnior - Elétrica |
Q438734
Engenharia Eletrônica
A Figura abaixo apresenta um circuito no qual o transistor bipolar Q1 é utilizado para controlar a potência dissipada pelo resistor de carga RL , e o gráfico com a evolução no tempo da tensão de controle VCTRL .
Considere que o transistor Q1 apresenta parâmetro β = 80, |VBE| = 0,7 V quando conduzindo corrente elétrica e |VCE| = 0,2 V quando operando em saturação.
Dessa forma, a potência média, em watts, dissipada pelo resistor de carga RL é
Considere que o transistor Q1 apresenta parâmetro β = 80, |VBE| = 0,7 V quando conduzindo corrente elétrica e |VCE| = 0,2 V quando operando em saturação.
Dessa forma, a potência média, em watts, dissipada pelo resistor de carga RL é
Q437335
Engenharia Eletrônica
Acerca do cabeamento estruturado, julgue o item subsecutivo.
Na figura a seguir, que ilustra uma estrutura de cabeamento centralizado que cria backbones/canais horizontais, as divisões de subsistemas identificadas estão de acordo com a NBR 14.565.
Na figura a seguir, que ilustra uma estrutura de cabeamento centralizado que cria backbones/canais horizontais, as divisões de subsistemas identificadas estão de acordo com a NBR 14.565.
Q437334
Engenharia Eletrônica
Acerca do cabeamento estruturado, julgue o item subsecutivo.
Perda de inserção é a atenuação de sinal ao longo dos canais, enlaces e componentes. Essa perda não é linearmente proporcional ao comprimento do cabo.
Perda de inserção é a atenuação de sinal ao longo dos canais, enlaces e componentes. Essa perda não é linearmente proporcional ao comprimento do cabo.
Q437312
Engenharia Eletrônica
Atraso de propagação é o tempo que um sinal elétrico leva para ser transmitido ao longo de um segmento de cabo entre transmissor e receptor. Esse parâmetro está diretamente associado à resistência, indutância e capacitância do cabo. Acerca desse assunto, julgue o item a seguir.
Considere que, em um sistema de cabeamento estruturado, um sinal de 1 MHz seja transmitido em um cabo de categoria 6 que possui 100 m de comprimento. Nesse caso, o atraso de propagação máximo permitido para o sinal é inferior a 600 ns.
Considere que, em um sistema de cabeamento estruturado, um sinal de 1 MHz seja transmitido em um cabo de categoria 6 que possui 100 m de comprimento. Nesse caso, o atraso de propagação máximo permitido para o sinal é inferior a 600 ns.
Q437311
Engenharia Eletrônica
Atraso de propagação é o tempo que um sinal elétrico leva para ser transmitido ao longo de um segmento de cabo entre transmissor e receptor. Esse parâmetro está diretamente associado à resistência, indutância e capacitância do cabo. Acerca desse assunto, julgue o item a seguir.
Delay skew é a diferença entre os atrasos de propagação dos pares mais rápido e mais lento em um cabo UTP de quatro pares.
Delay skew é a diferença entre os atrasos de propagação dos pares mais rápido e mais lento em um cabo UTP de quatro pares.
Q437310
Engenharia Eletrônica
Atraso de propagação é o tempo que um sinal elétrico leva para ser transmitido ao longo de um segmento de cabo entre transmissor e receptor. Esse parâmetro está diretamente associado à resistência, indutância e capacitância do cabo. Acerca desse assunto, julgue o item a seguir.
O atraso de propagação de um sinal transmitido em um cabo de categoria 5e é reduzido à metade ao se dobrar o valor da frequência do sinal.
O atraso de propagação de um sinal transmitido em um cabo de categoria 5e é reduzido à metade ao se dobrar o valor da frequência do sinal.
Q422876
Engenharia Eletrônica
Com base no circuito lógico apresentado, assinale a alternativa correta.
Q422868
Engenharia Eletrônica
Acerca das portas lógicas e da álgebra booleana, assinale a alternativa correta.
Ano: 2014
Banca:
FGV
Órgão:
DPE-RJ
Prova:
FGV - 2014 - DPE-RJ - Técnico Superior Especializado - Engenharia Elétrica |
Q422752
Engenharia Eletrônica
Considere as afirmativas abaixo a respeito de um sistema de segunda ordem com relação à análise de resposta transitória.
Situações
I. Subamortecido
II. Criticamente Amortecido
III. Sobreamortecido
Características
1. Dois polos reais e distintos. O sistema se aproxima do comportamento de um sistema de 1a ordem com o aumento do fator de amortecimento.
2. Dois polos reais e iguais. O sistema passa a não ter mais oscilações a partir do valor de fator de amortecimento igual à unidade.
3. O sistema apresenta oscilações e possui dois polos complexos conjugados.
A associação correta das situações com suas respectivas características é
Situações
I. Subamortecido
II. Criticamente Amortecido
III. Sobreamortecido
Características
1. Dois polos reais e distintos. O sistema se aproxima do comportamento de um sistema de 1a ordem com o aumento do fator de amortecimento.
2. Dois polos reais e iguais. O sistema passa a não ter mais oscilações a partir do valor de fator de amortecimento igual à unidade.
3. O sistema apresenta oscilações e possui dois polos complexos conjugados.
A associação correta das situações com suas respectivas características é
Ano: 2014
Banca:
FGV
Órgão:
DPE-RJ
Prova:
FGV - 2014 - DPE-RJ - Técnico Superior Especializado - Engenharia Elétrica |
Q422736
Engenharia Eletrônica
Considere as seguintes afirmativas a respeito de estabilidade de sistemas:
I. O sistema é estável se tiver qualquer polo na parte real positiva.
II. O sistema é estável se, quando sujeito a uma entrada impulso, a saída tende a zero à medida que o tempo tende ao infinito.
III. O sistema é criticamente estável se qualquer polo tiver a parte real nula.
Assinale - se
I. O sistema é estável se tiver qualquer polo na parte real positiva.
II. O sistema é estável se, quando sujeito a uma entrada impulso, a saída tende a zero à medida que o tempo tende ao infinito.
III. O sistema é criticamente estável se qualquer polo tiver a parte real nula.
Assinale - se
Ano: 2014
Banca:
FGV
Órgão:
DPE-RJ
Prova:
FGV - 2014 - DPE-RJ - Técnico Superior Especializado - Engenharia Elétrica |
Q422735
Engenharia Eletrônica
As memórias são compostas de um determinado número de células, em que cada uma pode armazenar parte de uma informação. Cada célula tem um endereço pelo qual os programas a referencia. A memória apresentada abaixo possui 7 células com 12 bits.
O endereço utilizado para acessar essa memória necessita no mínimo de
O endereço utilizado para acessar essa memória necessita no mínimo de
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